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參數(shù)資料
| 型號： | SPAK56853FG120 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 16-BIT, 4 MHz, OTHER DSP, PQFP128 |
| 封裝： | LQFP-128 |
| 文件頁數(shù)： | 457/649頁 |
| 文件大小： | 7965K |
| 代理商： | SPAK56853FG120 |
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DSP56800E Core Description
MOTOROLA
Overview
1-19
Preliminary
1
on 16- or 32-bit operands and yield results of the same size. The results of data ALU
operations are stored either in one of the data ALU registers or directly in memory.
1.4.8 Address Generation Unit (AGU)
The Address Generation Unit (AGU) performs all of the calculations of effective
addresses for data operands in memory. It contains two address ALUs, allowing up to two
24-bit addresses to be generated every instruction cycle:
1. One for either the Primary Data Address Bus (XAB1), or the Program Address Bus
(PAB)
2. One for the Secondary Data Address Bus (XAB2)
The address ALU can perform both linear and modulo address arithmetic. The AGU
operates independently of the other core units, minimizing address-calculation overhead.
The AGU can directly address 2
24 (16M) words on the XAB1 and XAB2 buses. It can
access 221 (2M) words on the PAB. The XAB1 bus can address byte, word, and long data
operands. The PAB and XAB2 buses can only address words in memory.
The AGU consists of the following registers and functional units:
Seven, (24-bit address registers (R0–R5 and N)
Four, 24-bit shadow registers for address registers (for R0, R1, M, and M01
A 24-bit dedicated Stack Pointer (SP) register
Two offset registers (N and N3)
A 16-bit modifier register (M01)
A 24-bit adder unit
A 24-bit modulo arithmetic unit
Each of the address registers (R0–R5) can contain either data or an address. All of these
registers can provide an address for the XAB1 and PAB address buses; addresses on the
XAB2 bus are provided by the R3 register. The N offset register can be used either as a
general-purpose address register or as an offset or update value for the addressing modes
supporting those values. The second 16-bit offset register (N3) is used only for offset or
update values. The modifier register (M01) selects between linear and modulo address
arithmetic.
1.4.9 Program Controller and Hardware Looping Unit
The Program Controller is responsible for instruction fetching and decoding, interrupt
processing, hardware interlocking, and hardware looping. Actual instruction execution
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SPAK56855BU120 | 16-BIT, 4 MHz, OTHER DSP, PQFP100 |
| SPAK56854FG120 | 16-BIT, 4 MHz, OTHER DSP, PQFP128 |
| SPAK56F802TA60 | 0-BIT, 60 MHz, OTHER DSP, PQFP32 |
| SPAK56F805FV80 | 16-BIT, 8 MHz, OTHER DSP, PQFP144 |
| SPAK56F807VF80 | 16-BIT, 80 MHz, OTHER DSP, PBGA160 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SPAK56854FG120 | 制造商:Freescale Semiconductor 功能描述: |
| SPAK56857BU120 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:120 MIPS Hybrid Processor |
| SPAK56F803BU80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAK56F805FV80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAKDSP303AG100 | 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC SPAKDSP303AG100 RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT |
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