參數(shù)資料
型號： TMS320C2812ZHHS
廠商： TEXAS INSTRUMENTS INC
元件分類： 數(shù)字信號處理
英文描述： 16-BIT, 150 MHz, OTHER DSP, PBGA179
封裝： LEAD FREE, BGA-179
文件頁數(shù)： 48/156頁
文件大?。?/td> 1826K
代理商： TMS320C2812ZHHS
Electrical Specifications
141
April 2001 Revised October 2005
SPRS174M
ac
Rs
ADCIN0
Cp
10 pF
Ron
1 k
1.25 pF
Ch
Switch
Typical Values of the Input Circuit Components:
Switch Resistance (Ron):
1 k
Sampling Capacitor (Ch):
1.25 pF
Parasitic Capacitance (Cp): 10 pF
Source Resistance (Rs):
50
28x DSP
Source
Signal
Figure 638. ADC Analog Input Impedance Model
6.30.4
ADC Power-Up Control Bit Timing
ADC Power Up Delay
ADC Ready for Conversions
PWDNBG
PWDNREF
PWDNADC
Request for
ADC
Conversion
td(BGR)
td(PWD)
Figure 639. ADC Power-Up Control Bit Timing
Table 644. ADC Power-Up Delays
MIN
TYP
MAX
UNIT
td(BGR)
Delay time for band gap reference to be stable. Bits 7 and 6 of the ADCTRL3 register
(ADCBGRFDN1/0) are to be set to 1 before the ADCPWDN bit is enabled.
7
8
10
ms
td(PWD)
Delay time for power-down control to be stable. Bit 5 of the ADCTRL3 register
20
50
s
td(PWD)
Delay time for power-down control to be stable. Bit 5 of the ADCTRL3 register
(ADCPWDN) is to be set to 1 before any ADC conversions are initiated.
1
ms
These delays are necessary and recommended to make the ADC analog reference circuit stable before conversions are initiated. If conversions
are started without these delays, the ADC results will show a higher gain. For power down, all three bits can be cleared at the same time.
相關PDF資料
PDF描述
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