參數(shù)資料
型號： TMS320C2812ZHHS
廠商： TEXAS INSTRUMENTS INC
元件分類： 數(shù)字信號處理
英文描述： 16-BIT, 150 MHz, OTHER DSP, PBGA179
封裝： LEAD FREE, BGA-179
文件頁數(shù)： 60/156頁
文件大?。?/td> 1826K
代理商： TMS320C2812ZHHS
Electrical Specifications
152
April 2001 Revised October 2005
SPRS174M
Table 655. McBSP as SPI Master or Slave Timing Requirements (CLKSTP = 11b, CLKXP = 1)
NO.
MASTER
SLAVE
UNIT
NO.
MIN
MAX
MIN
MAX
UNIT
M58
tsu(DRV-CKXL)
Setup time, DR valid before CLKX low
30
8P 10
ns
M59
th(CKXL-DRV)
Hold time, DR valid after CLKX low
1
8P 10
ns
M60
tsu(FXL-CKXL)
Setup time, FSX low before CLKX low
16P +
10
ns
M61
tc(CKX)
Cycle time, CLKX
2P
16P
ns
Table 656. McBSP as SPI Master or Slave Switching Characteristics (CLKSTP = 11b, CLKXP = 1)
NO.
PARAMETER
MASTER
SLAVE
UNIT
NO.
PARAMETER
MIN
MAX
MIN
MAX
UNIT
M53
th(CKXH-FXL)
Hold time, FSX low after CLKX high
P
ns
M54
td(FXL-CKXL)
Delay time, FSX low to CLKX low
2P
ns
M56
tdis(CKXH-DXHZ)
Disable time, DX high impedance following last data bit
from CLKX high
P+6
7P + 6
ns
M57
td(FXL-DXV)
Delay time, FSX low to DX valid
6
4P + 6
ns
2P = 1/CLKG
For all SPI slave modes, CLKX has to be minimum 8 CLKG cycles. Also CLKG should be LSPCLK/2 by setting CLKSM = CLKGDV = 1. With
maximum LSPCLK speed of 75 MHz, CLKX maximum frequency will be LSPCLK/16 , that is 4.6875 MHz and P =13.3 ns.
C = CLKX low pulse width = P
D = CLKX high pulse width = P
Bit 0
Bit(n-1)
(n-2)
(n-3)
(n-4)
Bit 0
Bit(n-1)
(n-2)
(n-3)
(n-4)
CLKX
FSX
DX
DR
M54
M58
M56
M53
M55
M59
M57
LSB
MSB
M60
M61
Figure 647. McBSP Timing as SPI Master or Slave: CLKSTP = 11b, CLKXP = 1
相關(guān)PDF資料
PDF描述
TMS320C6747BZKB4 OTHER DSP, PBGA256
TMS320LF2407APGEA 16-BIT, 20 MHz, OTHER DSP, PQFP144
TMS426409AP-60DJ 4M X 4 EDO DRAM, 60 ns, PDSO24
TMS426809AP-70DGC 2M X 8 EDO DRAM, 70 ns, PDSO28
TMS44400DJ-80 1M X 4 FAST PAGE DRAM, 80 ns, PDSO20
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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