參數(shù)資料
型號(hào)： TS68230CP10
廠商： 意法半導(dǎo)體
英文描述： HMOS PARALLEL INTERFACE/TIMER
中文描述： HMO的并行接口/定時(shí)器
文件頁(yè)數(shù)： 56/61頁(yè)
文件大?。?/td> 2911K
代理商： TS68230CP10
6.6. AC ELECTRICAL SPECIFICATIONS
(V
CC
= 5.0Vdc
±
5%, V
SS
= 0Vdc, T
A
= T
L
to T
H
unless otherwise noted)
Iack Timings
(figure 6.6)
8MHz
Min.
0
10MHz
Min.
0
Number
Parameter
Max.
Max.
Unit
8
9
CS or PIACK or TIACK High to Data Out Invalid (hold time)
CS or PIACK or TIACK High to D0-D7 High Impedance
CS or PIACK or TIACK High to DTACK High
CS or PIACK or TIACK High to DTACK High Impedance
CLK Low to Data Output Valid, Interrupt Acknowledge Cycle
PIACK or TIACK Low to CLK Low (setup time)
CLK
Low
to
DTACK
Low
Interrupt
Acknowledge
Cycle
(delay
time)
ns
ns
ns
ns
ns
ns
ns
50
50
100
120
45
45
55
100
10
11
29
31
34
50
40
100
100
Figure 6.6 :
IACK Timing Diagram.
Notes :
1. This specification assures recognition of the asserted edge of H1(H3).
TS68230
56/61
相關(guān)PDF資料
PDF描述
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