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參數(shù)資料
| 型號： | TVP3030-250 |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | Video Interface PALETTE Exract(1600×1200，24位真彩色視頻接口調(diào)色器) |
| 中文描述： | 視頻接口調(diào)色板Exract（1600 × 1200,24位真彩色視頻接口調(diào)色器） |
| 文件頁數(shù)： | 61/107頁 |
| 文件大?。?/td> | 689K |
| 代理商： | TVP3030-250 |
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2–45
2.16 Register Definitions
2.16.1
General-Control Register (Index: 0x1D, Access: R/W, Default: 0x00)
The general-control register definition is listed in Table 2–23.
Table 2–23. General-Control Register
BIT
NAME
VALUES
DESCRIPTION
GCR7
0
Reserved
GCR6
0: Disable (default)
Overscan enable. Specifies whether to enable the user-defined overscan
Overscan enable. Specifies whether to enable the user defined overscan
screen border.
1: Enable
GCR5
0: Disable (default)
Sync enable. This bit specifies whether sync information is to be output onto
IOG.
1: Enable
GCR4
0: 0 IRE (default)
Pedestal control. This bit specifies whether a 0 or 7.5 IRE blanking pedestal
is to be generated on the video outputs.
1: 7.5 IRE
GCR3
0: Little-endian (default)
Little-endian/big-endian select. Selects either little- or big-endian format for the
Little endian/big endian select. Selects either little or big endian format for the
pixel-bus interface.
1: Big-endian
GCR2
0
Reserved
GCR1
0: Do not invert (default)
VSYNCOUT output polarity.
1: Invert
GCR0
0: Do not invert (default)
1: Invert (high)
HSYNCOUT output polarity.
2.16.2
Miscellaneous-Control Register (Index: 0x1E, Access: R/W, Default: 0x00)
The miscellaneous-control register definition is listed in Table 2–24.
Table 2–24. Miscellaneous-Control Register
BIT
NAME
VALUES
DESCRIPTION
MSC7
0
Reserved
MSC6
0
Reserved
MSC5
0: Palette RAM
(default)
Palette bypass bit. This bit selects between the color palette RAM and the
direct-color pipeline delay for the input to the DACs. When the palette RAM is
selected, the data can be from the VGA port or from the pixel port as pseudo-color,
true-color, or overlay data. MSC5 is logically ORed with the color key switching
function. The color-key switching function defaults to palette bypass. MSC5 can
then be used to select between palette RAM when logic 0, and palette bypass
when logic 1.
1: Palette Bypass
MSC4
0
Reserved
MSC3
0: 6-bit (default)
8- or 6-bit operation bit. This bit selects the DAC resolution and the number of bits
8 or 6 bit operation bit. This bit selects the DAC resolution and the number of bits
used for each color in each palette RAM.
1: 8-bit
MSC2
0
Reserved
MSC1
0
Reserved
MSC0
0: Disable (default)
1: Enable
DAC power down If set to logic 1 the DACs power down
DAC power down. If set to logic 1, the DACs power down.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TVP3409-170 | Advanced Video Interface PALETTE(雙PLL，視頻接口調(diào)色器真彩色CMOS) |
| TVP3409-135 | Advanced Video Interface PALETTE(雙PLL，視頻接口調(diào)色器真彩色CMOS) |
| TVP3703-170 | Video Interface PALETTE Exract(雙PLL，先進的視頻接口調(diào)色器) |
| TVP3703-135 | Video Interface PALETTE Exract(雙PLL，先進的視頻接口調(diào)色器) |
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參數(shù)描述 |
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| TVP3033-220 | 制造商:TI 制造商全稱:Texas Instruments 功能描述:Video Interface Palette |
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