參數(shù)資料
型號(hào)： TVP5031
廠商： Texas Instruments, Inc.
英文描述： NTSC/PAL VIDEO DECODER
中文描述： NTSC / PAL視頻解碼器
文件頁(yè)數(shù)： 40/85頁(yè)
文件大?。?/td> 378K
代理商： TVP5031
2–24
2.6.3
Parallel Host Interface B
Parallel host interface B is compatible with Video Electronics Standards Association (VESA) Video Module Interface
(VMI) proposal version 1.4 mode B. The terminal descriptions are defined in Table 2–5.
Table 2–5. Parallel Host Interface B Terminal Description
TERMINAL
SIGNAL
TYPE
DESCRIPTION
A[1:0]
HA[1:0]
I
Address bus from host
D[7:0]
HD[7:0]
I/O
Bidirectional data bus
VC3
CS
I
Chip select, active low
VC2
RD
I
Read, active low
VC1
WR
I
Write, active high
VC0
RDY
O
Data acknowledge
INTREQ
O
Interrupt request,
Open drain by default, active low, pullup resistor required
Can be configured, subaddress C2, as a conventional CMOS buffer, active high, no pullup
required.
Parallel host interface B timing is shown in Figure 2–28. The cycle is initiated by the host when VC2-RD OR VC1-WR
transitions low. The TVP5031 responds by pulling VC0-RDY low. The TVP5031 will then set VC0-RDY to high
impedance, a pullup resistor is required, to indicate the data was received or that the requested data is present on
the bus. The host then completes the cycle by pulling the asserted signal, VC2-RD or VC1-WR high.
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PDF描述
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