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參數(shù)資料
| 型號： | UPD17073 |
| 廠商： | NEC Corp. |
| 英文描述： | FILTER BAND PASS 5.8GHZ SMD |
| 中文描述： | 4位單芯片的數(shù)字調(diào)諧系統(tǒng)硬件單片機(jī) |
| 文件頁數(shù)： | 117/226頁 |
| 文件大?。?/td> | 1250K |
| 代理商： | UPD17073 |
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μ
PD17072,17073
117
14.5 Presettable Shift Register
The presettable shift register is an 8-bit shift register that writes serial-out data and reads serial-in data.
Writing/reading data to/from the presettable shift register is performed by PUT and GET instructions via data buffer.
The presettable shift register outputs (transmits) the content of its most significant bit (MSB) from the serial data
I/O pin in synchronization with the falling edge of the shift clock, and reads data to its least significant bit (LSB) in
synchronization with the rising edge of the shift clock.
Figure 14-4 shows the configuration and function of the presettable shift register.
Figure 14-4. Configuration of Presettable Shift Register
Note
If the PUT or GET instruction is executed during serial communication, the data may be lost. For details,
refer to
14.8 Notes on Setting and Reading Data
.
14.6 Wait Control Block
The wait control block performs wait (pause) control of communication.
By releasing the wait status by using the SIOTS flag of the serial I/O mode select register, serial communication
is started.
After the wait status has been released, and communication has been started, the wait status is resumed if shift
clock rises at clock counter “8”.
The communication status can be detected by the SIOTS flag.
That is, the communication status can be detected by detecting the status of the SIOTS flag after setting “1” to
the SIOTS flag.
If “0” is written to the SIOTS flag while the wait status is released, the wait status is set. This is called a forced
wait status.
For the configuration and function of the serial I/O mode select register, refer to
Figure 14-3
.
Setting of serial-out data and reading of
serial-in data
DBF3
Data buffer
Name
b
0
Symbol
Peripheral register
D7 D6 D5 D4 D3 D2 D1
M
S
B
L
S
B
b
1
b
2
b
3
b
4
b
5
b
6
b
7
Presettable
shift register
Valid data
Peripheral address
SIOSFR
03H
D7
D6
D5
D4
D3
D2
D1
D0
D0
Serial out
Serial in
8
GET
Note
PUT
Note
Transfer data
Don't care
DBF2
Don't care
DBF1
DBF0
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