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參數(shù)資料
| 型號(hào)： | UPD17073 |
| 廠商： | NEC Corp. |
| 英文描述： | FILTER BAND PASS 5.8GHZ SMD |
| 中文描述： | 4位單芯片的數(shù)字調(diào)諧系統(tǒng)硬件單片機(jī) |
| 文件頁(yè)數(shù)： | 177/226頁(yè) |
| 文件大?。?/td> | 1250K |
| 代理商： | UPD17073 |
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μ
PD17072,17073
177
19.2.7
When two or more release conditions are specified
When two or more halt release conditions are specified, the halt mode is released if any one of the specified
conditions is satisfied.
The following example shows how the condition is identified when two or more conditions are specified:
Example
HLTINT
HLTTMR
HLTKEY
INTPIN
DAT 1000B
DAT 0010B
DAT 0001B
DAT 0003H
;
Vector address symbol definition of INT pin interrupt
START:
BR
INTPIN
Processing A
EI
RETI
MAIN
ORG
;
INT pin interrupt service
TMRUP:
;
Basic timer 0 processing
Processing B
RET
KEYDEC:
;
Key input processing
Processing C
RET
MAIN:
BANK1
MOV
SET1
P1B, #1111B
IP
;
;
;
Outputs P1B3-P1B0 at high level as key source output
Embedded macro
Enables INT pin interrupt
EI
LOOP:
HALT
HLTINT OR HLTTMR OR HLTKEY
;
;
;
;
Specifies external interrupt (INT pin), basic timer 0,
and key input as halt release condition
Embedded macro
Detects BTM0CY flag
SKT1
BTM0CY
BR
CALL
BR
KEY_DEC
TMRUP
LOOP
;
Basic timer 0 processing if set to “1”
KEYDEC:
Key processing
BR
LOOP
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