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參數(shù)資料
| 型號： | UPD17073 |
| 廠商： | NEC Corp. |
| 英文描述： | FILTER BAND PASS 5.8GHZ SMD |
| 中文描述： | 4位單芯片的數(shù)字調(diào)諧系統(tǒng)硬件單片機(jī) |
| 文件頁數(shù)： | 18/226頁 |
| 文件大?。?/td> | 1250K |
| 代理商： | UPD17073 |
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μ
PD17072,17073
18
1.3 Processing of Unused Pins
It is recommended that the unused pins be connected as follows:
Table 1-1. Processing of Unused Pins
Pin name
I/O mode
Recommended processing of unused pins
Port pin
P0A0-P0A3
CMOS push-pull output
Open
P0B0, P0B1
I/O
Note 1
Set by software to output low level and open
P0B2/SCK
P0B3/SI/SO1
P0C0, P0C1
P0D2/AMIFC
P0D3/FMIFC/AMIFC
P1A0, P1A1
Input
Connect each of these pins to V
DD
or GND via resistor
Note 2
.
P1A2/AD0
P1A3/AD1
P1B0-P1B3
CMOS push-pull output
Open
P1C0/SO0
Pins other
than port
pins
BEEP
CMOS push-pull output
Open
CE
Input
Connect to V
DD
via resistor
Note 2
.
COM0-COM3
Output
Open
EO
Output
INT
Input
Connect to GND via resistor
Note 2
.
LCD0-LCD14
CMOS push-pull output
Open
VCOH, VCOL
Input
Connect each of these pins to GND via resistor
Note 2
.
Notes 1.
The I/O ports are set in the input mode on power application, on clock stop, and on CE reset.
2.
When pulling up (connecting to V
DD
via resistor) or pulling down (connecting to GND via resistor) a pin
externally with high resistance, the pin almost goes into a high-impedance state, and consequently, the
current consumption (through current) of the port increases. Generally, the pull-up or pull-down
resistance is several 10 k
, though it varies depending on the application circuit.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
|---|---|
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| UPD1708AG-011-00 | 制造商:NEC 制造商全稱:NEC 功能描述:PLL FREQUENCY SYNTHESIZER AND CONTROLLER FOR FM/MW/LW TUNER |
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