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參數資料
| 型號： | UPD17073 |
| 廠商： | NEC Corp. |
| 英文描述： | FILTER BAND PASS 5.8GHZ SMD |
| 中文描述： | 4位單芯片的數字調諧系統(tǒng)硬件單片機 |
| 文件頁數： | 185/226頁 |
| 文件大?。?/td> | 1250K |
| 代理商： | UPD17073 |
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μ
PD17072,17073
185
19.6 Device Control Function by CE Pin
The CE pin has the following functions by using the input level and rising edge of a signal input from an external
source:
(1) PLL frequency synthesizer
(2) Making clock stop instruction valid or invalid
(3) Resets device
19.6.1 Controlling operation of PLL frequency synthesizer
The PLL frequency synthesizer can operate only when the CE pin is high.
When the CE pin is low, PLL is automatically disabled.
When PLL is disabled, the VCOH and VCOL pins are floated, and the EO pin is also floated.
The PLL frequency synthesizer can also be disabled through program even when the CE pin is high.
19.6.2 Making clock stop instruction valid or invalid
The clock stop instruction (“STOP s”) is valid only when the CE pin is low.
The clock stop instruction executed when the CE pin is high is treated as an NOP (no operation) instruction.
19.6.3 Resetting device
The device can be reset by raising the CE pin (CE reset).
The device can also be reset by turning off supply voltage V
DD
(power-ON reset).
For details, refer to
20. RESET
.
相關PDF資料 |
PDF描述 |
|---|---|
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相關代理商/技術參數 |
參數描述 |
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