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參數(shù)資料
| 型號(hào)： | UPD17073 |
| 廠商： | NEC Corp. |
| 英文描述： | FILTER BAND PASS 5.8GHZ SMD |
| 中文描述： | 4位單芯片的數(shù)字調(diào)諧系統(tǒng)硬件單片機(jī) |
| 文件頁數(shù)： | 199/226頁 |
| 文件大小： | 1250K |
| 代理商： | UPD17073 |
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μ
PD17072,17073
199
20.6 Power Failure Detection
The power failure detection feature is used to judge, when the device has been reset, whether the reset has been
effected by application of supply voltage V
DD
or by the CE pin.
Because the contents of the data memory and output ports are “undefined” on power application, the contents of
these are initialized by detecting a power failure.
The power failure can be detected by detecting the BTM0CY flag by using a power failure detector circuit.
Figure 20-7. Power Failure Detection Flowchart
20.6.1 Power Failure Detector Circuit
The power failure detector circuit consists of a voltage detector circuit as shown in Figure 20-1, basic timer 0 carry
disable flip-flop that is reset by the output (power-ON clear signal) of the voltage detector circuit, and basic timer 0
carry.
The basic timer 0 carry disable FF is set to 1 by the power-ON clear signal, and reset to 0 when an instruction that
reads the BTM0CY flag has been executed.
While the basic timer 0 carry disable FF is set to 1, the BTM0CY flag is not set to 1.
If the power-ON clear signal is output (at power-ON reset), therefore, the program is started with the BTM0CY flag
cleared, and setting of the BTM0CY flag is inhibited until an instruction that reads the BTM0CY flag is executed later.
Once the instruction that reads the BTM0CY flag has been executed, the BTM0CY flag is set each time the basic
timer 0 carry FF setting pulse rises. Therefore, whether power-ON reset (power failure) or CE reset (not power failure)
has been effected can be judged by checking the content of the BTM0CY flag, when the device has been reset. That
is, if the BTM0CY flag is cleared to 0, power-ON reset has been effected; if the flag is set to 1, CE reset has been
effected.
The voltage at which a power failure can be detected is the same voltage at which power-ON reset is effected.
Figure 20-8 illustrates the status transition of the BTM0CY flag. Figure 20-9 shows the timing chart of Figure
20-8 and the operation of the BTM0CY flag.
Program starts
Power failure
detected
Not power failure
Power failure
Initializes data
memory and
output ports
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