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參數(shù)資料
| 型號： | UPD30102GM-54-8EV |
| 廠商： | NEC Corp. |
| 英文描述： | 64/32-bit Microprocessor |
| 中文描述： | 64/32微處理器 |
| 文件頁數(shù)： | 164/701頁 |
| 文件大?。?/td> | 2329K |
| 代理商： | UPD30102GM-54-8EV |
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CHAPTER 6 EXCEPTION PROCESSING
164
(1) Interrupt enable
Interrupts are enabled when all of the following conditions are true:
—
IE is set to 1.
—
EXL is cleared to 0.
—
ERL is cleared to 0.
—
The appropriate bit of the IM is set to 1.
(2) Operating modes
The following Status register bit settings are required for User, Kernel, and Supervisor modes.
—
The processor is in User mode when KSU = 10, EXL = 0, and ERL = 0.
—
The processor is in Supervisor mode when KSU = 01, EXL = 0, and ERL = 0.
—
The processor is in Kernel mode when KSU = 00, EXL = 1, or ERL = 1.
(3) 32- and 64-bit modes
The following Status register bit settings select 32- or 64-bit operation for User, Kernel, and Supervisor
operating modes. Enabling 64-bit operation permits the execution of 64-bit opcodes and translation of 64-bit
addresses. 64-bit operation for User, Kernel and Supervisor modes can be set independently.
—
64-bit addressing for Kernel mode is enabled when KX bit = 1. 64-bit operations are always valid in Kernel
mode.
—
64-bit addressing and operations are enabled for Supervisor mode when SX bit = 1.
—
64-bit addressing and operations are enabled for User mode when UX bit = 1.
(4) Kernel address space accesses
Access to the kernel address space is allowed when the processor is in Kernel mode.
(5) Supervisor address space accesses
Access to the supervisor address space is allowed when the processor is in Supervisor or Kernel mode.
(6) User address space accesses
Access to the user address space is allowed in any of the three operating modes.
(7) Status after reset
The contents of the Status register are undefined after resets, except for the following bits.
x
TS and SR are cleared to 0.
x
ERL and BEV are set to 1.
x
SR is 0 after Cold reset, and is 1 after Soft reset or NMI interrupt.
Remark
Cold reset and Soft reset are CPU core reset (see
7.4 RESET OF THE CPU CORE
). For the reset of
all the V
R
4102 including peripheral units, refer to
CHAPTER 7 INITIALIZATION INTERFACE
and
CHAPTER 15 PMU
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD30102GM-66-8EV | 64/32-bit Microprocessor |
| UPD30102S1-54-3C | 64/32-bit Microprocessor |
| UPD30102S1-66-3C | 64/32-bit Microprocessor |
| UPD30550F2-300-NN1 | VR5500⑩ 64-/32-BIT MICROPROCESSOR |
| UPD30550F2-400-NN1 | VR5500⑩ 64-/32-BIT MICROPROCESSOR |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| UPD30102GM-66-8EV | 制造商:NEC 制造商全稱:NEC 功能描述:64/32-bit Microprocessor |
| UPD30102S1-54-3C | 制造商:NEC 制造商全稱:NEC 功能描述:64/32-bit Microprocessor |
| UPD30102S1-66-3C | 制造商:NEC 制造商全稱:NEC 功能描述:64/32-bit Microprocessor |
| UPD30111S1-70-3C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MICROPROCESSOR|32-BIT|CMOS|BGA|224PIN|PLASTIC |
| UPD30121 | 制造商:NEC 制造商全稱:NEC 功能描述:VR4121TM 64-/32-BIT MICROPROCESSOR |
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