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參數(shù)資料
| 型號： | V54C316802VB |
| 廠商： | Mosel Vitelic, Corp. |
| 英文描述： | High Performance 3.3 Volt 2M X 8 Synchronous DRAM(3.3V高性能2Mx8同步動態(tài)RAM) |
| 中文描述： | 高性能3.3伏200萬× 8同步DRAM（3.3V的高性能2Mx8同步動態(tài)RAM）的 |
| 文件頁數(shù)： | 58/60頁 |
| 文件大?。?/td> | 586K |
| 代理商： | V54C316802VB |
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10
V54C316802VB Rev. 1.0 March 1998
MOSEL V ITELIC
V54C316802VB
AC Characteristics
1,2, 3
T
A
= 0 to 70
°
C; V
SS
= 0 V; V
CC
= 3.3 V
±
0.3 V, t
T
= 1 ns
#
Symbol
Parameter
Limit Values
Unit
Note
-8
-10
Min.
Max.
Min.
Max.
Clock and Clock Enable
1
t
CK
Clock Cycle Time
CAS Latency = 3
CAS Latency = 2
8
10
–
–
10
12
–
–
s
ns
ns
2
t
CK
Clock Frequency
CAS Latency = 3
CAS Latency = 2
–
–
125
100
–
–
100
83
MHz
MHz
3
t
AC
Access Time from Clock
CAS Latency = 3
CAS Latency = 2
–
–
6
6
–
–
7
8
ns
ns
2, 4
4
t
CH
Clock High Pulse Width
3
–
3
–
ns
5
t
CL
Clock Low Pulse Width
3
–
3
–
ns
6
t
T
Transition Time
(rise and fall)
0.5
10
0.5
10
ns
Setup and Hold Times
7
t
IS
Input Setup Time
2
–
3
–
ns
5
8
t
IH
Input Hold Time
1
–
1
–
ns
5
9
t
CKS
CKE Setup Time
2
–
3
–
ns
5
10
t
CKH
CKE Hold Time
1
–
1
–
ns
5
11
t
RSC
Mode Register Set-up Time
16
–
20
–
ns
12
t
SB
Power Down Mode Entry Time
0
8
0
10
ns
Common Parameters
13
t
RCD
Row to Column Delay Time
20
–
24
–
ns
6
14
t
RAS
Row Active Time
45
100k
60
100k
ns
6
15
t
RCD
Row to Column Delay Time
20
–
24
–
ns
6
16
t
RP
Row Precharge Time
20
–
24
–
ns
6
17
t
RC
Row Cycle Time
70
–
90
–
ns
6
18
t
RRD
Activate(a) to Activate(b) Command Period
16
–
20
–
ns
6
19
t
CCD
CAS(a) to CAS(b) Command Perriod
1
–
1
–
CLK
Refresh Cycle
20
t
REF
Refresh Period (4096 cycles)
—
64
—
64
ms
21
t
SREX
Self Refresh Exit Time
10
10
ns
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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