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參數(shù)資料
| 型號： | V54C316802VB |
| 廠商： | Mosel Vitelic, Corp. |
| 英文描述： | High Performance 3.3 Volt 2M X 8 Synchronous DRAM(3.3V高性能2Mx8同步動態(tài)RAM) |
| 中文描述： | 高性能3.3伏200萬× 8同步DRAM（3.3V的高性能2Mx8同步動態(tài)RAM）的 |
| 文件頁數(shù)： | 6/60頁 |
| 文件大小： | 586K |
| 代理商： | V54C316802VB |
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17
V54C316802VB Rev. 1.0 February 1999
MOSEL V ITELIC
V54C316802VB
4.2 Minimum Read to Write Interval
(Burst Length = 4, CAS latency = 1, 2)
4.3 Non-Minimum Read to Write Interval
(Burst Length = 4, CAS latency = 3
COMMAND
NOP
BANK A
ACTIVATE
NOP
READ A
WRITE A
NOP
NOP
NOP
DQM
DIN A0
DIN A1
DIN A2
DIN A3
DIN A0
DIN A1
DIN A2
DIN A3
Must be Hi-Z before
the Write Command
t
CK1,
I/O’s
CAS latency = 1
t
CK2,
I/O’s
CAS latency = 2
CLK
T0
T2
T1
T3
T4
T5
T6
T7
T8
NOP
1 Clk Interval
t
DQZ
t
DQW
: “H” or “L”
NOP
READ A
NOP
NOP
READ A
NOP
WRITE B
NOP
NOP
DQM
DIN B0
DIN B1
DIN B2
t
CK1,
I/O’s
CAS latency = 1
t
CK2,
I/O’s
CAS latency = 2
CLK
T0
T2
T1
T3
T4
T5
T6
T7
T8
DOUT A1
DOUT A0
DOUT A0
DIN B0
DIN B1
DIN B2
COMMAND
DIN B0
DIN B1
DIN B2
DOUT A2
DOUT A1
DOUT A0
Must be Hi-Z before
the Write Command
t
CK3,
I/O’s
CAS latency = 3
t
DQZ
t
DQW
: “H” or “L”
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| V54C3256164VAB | 256Mbit SDRAM 3.3 VOLT, TSOP II / SOC BGA / WBGA PACKAGE 16M X 16, 32M X 8, 64M X 4 |
| V54C3256164VBUC | LOW POWER 256Mbit SDRAM 3.3 VOLT, 54-BALL SOC BGA 54-PIN TSOPII 16M X 16 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| V54C3256164VAB | 制造商:MOSEL 制造商全稱:MOSEL 功能描述:256Mbit SDRAM 3.3 VOLT, TSOP II / SOC BGA / WBGA PACKAGE 16M X 16, 32M X 8, 64M X 4 |
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| V54C3256164VB | 制造商:MOSEL 制造商全稱:MOSEL 功能描述:256Mbit SDRAM 3.3 VOLT, TSOP II / SOC BGA / WBGA PACKAGE 16M X 16, 32M X 8, 64M X 4 |
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