參數(shù)資料
型號： XA3SD1800A-4FGG676I
廠商： Xilinx Inc
文件頁數(shù)： 46/58頁
文件大?。?/td> 0K
描述： SPARTAN-3ADSP FPGA 1800K 676FBGA
產(chǎn)品培訓(xùn)模塊： Extended Spartan 3A FPGA Family
標(biāo)準(zhǔn)包裝： 40
系列： Spartan®-3A DSP XA
LAB/CLB數(shù)： 4160
邏輯元件/單元數(shù)： 37440
RAM 位總計(jì)： 1548288
輸入/輸出數(shù)： 519
門數(shù)： 1800000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 676-BGA
供應(yīng)商設(shè)備封裝： 676-FBGA（27x27）
配用： 122-1574-ND - KIT DEVELOPMENT SPARTAN 3ADSP
XA Spartan-3A DSP Automotive FPGA Family Data Sheet
DS705 (v2.0) April 18, 2011
Product Specification
50
Table 48: CCLK Output Frequency by ConfigRate Option Setting
Symbol
Description
ConfigRate
Setting
Temperature
Range
Minimum
Maximum
Units
FCCLK1
Equivalent CCLK clock frequency
by ConfigRate setting
1
(power-on value)
I-Grade/
Q-Grade
0.400
0.847
MHz
FCCLK3
3
I-Grade/
Q-Grade
1.20
2.57
MHz
FCCLK6
6
I-Grade/
Q-Grade
2.40
5.13
MHz
FCCLK7
7
I-Grade/
Q-Grade
2.80
5.96
MHz
FCCLK8
8
I-Grade/
Q-Grade
3.20
6.81
MHz
FCCLK10
10
I-Grade/
Q-Grade
4.00
8.63
MHz
FCCLK12
12
I-Grade/
Q-Grade
4.80
10.31
MHz
FCCLK13
13
I-Grade/
Q-Grade
5.20
11.37
MHz
FCCLK17
17
I-Grade/
Q-Grade
6.80
14.61
MHz
FCCLK22
22
I-Grade/
Q-Grade
8.80
19.61
MHz
FCCLK25
25
I-Grade/
Q-Grade
10.00
22.23
MHz
FCCLK27
27
I-Grade/
Q-Grade
10.80
23.81
MHz
FCCLK33
33
I-Grade/
Q-Grade
13.20
29.23
MHz
FCCLK44
44
I-Grade/
Q-Grade
17.60
40.00
MHz
FCCLK50
50
I-Grade/
Q-Grade
20.00
47.66
MHz
FCCLK100
100
I-Grade/
Q-Grade
40.00
94.34
MHz
Table 49: CCLK Output Minimum Low and High Time
Symbol
Description
ConfigRate Setting
Units
1
3
6
7
8
10
12
1317
2225
27
33
44
50
100
TMCCL,
TMCCH
CCLK
Minimum Low
and High Time
I-Grade/
Q-Grade
560 185 92.6 79.8
69.8 55.0 46.0 41.8
32.3
24.2
21.4
20.0
16.2
11.9
10.0
5.0
ns
Table 50: CCLK Input Low and High Time
Symbol
Description
Min
Max
Units
TSCCL,
TSCCH
CCLK Low and High time
5
ns
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PDF描述
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