參數(shù)資料
型號(hào)： XA3SD1800A-4FGG676I
廠商： Xilinx Inc
文件頁數(shù)： 50/58頁
文件大小： 0K
描述： SPARTAN-3ADSP FPGA 1800K 676FBGA
產(chǎn)品培訓(xùn)模塊： Extended Spartan 3A FPGA Family
標(biāo)準(zhǔn)包裝： 40
系列： Spartan®-3A DSP XA
LAB/CLB數(shù)： 4160
邏輯元件/單元數(shù)： 37440
RAM 位總計(jì)： 1548288
輸入/輸出數(shù)： 519
門數(shù)： 1800000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 676-BGA
供應(yīng)商設(shè)備封裝： 676-FBGA（27x27）
配用： 122-1574-ND - KIT DEVELOPMENT SPARTAN 3ADSP
XA Spartan-3A DSP Automotive FPGA Family Data Sheet
DS705 (v2.0) April 18, 2011
Product Specification
54
Table 54: Configuration Timing Requirements for Attached SPI Serial Flash
Symbol
Description
Requirement
Units
TCCS
SPI serial Flash PROM chip-select time
ns
TDSU
SPI serial Flash PROM data input setup time
ns
TDH
SPI serial Flash PROM data input hold time
ns
TV
SPI serial Flash PROM data clock-to-output time
ns
fC or fR
Maximum SPI serial Flash PROM clock frequency (also depends on
specific read command used)
MHz
Notes:
1.
These requirements are for successful FPGA configuration in SPI mode, where the FPGA generates the CCLK signal. The
post-configuration timing can be different to support the specific needs of the application loaded into the FPGA.
2.
Subtract additional printed circuit board routing delay as required by the application.
T
CCS
T
MCCL1
T
CCO
–
T
DSU
T
MCCL1
T
CCO
–
T
DH
T
MCCH1
T
V
T
MCCLn
T
DCC
–
f
C
1
T
CCLKn min
---------------------------------
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PDF描述
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