參數(shù)資料
型號(hào)： XC3S50-4TQG144I
廠商： Xilinx Inc
文件頁(yè)數(shù)： 11/272頁(yè)
文件大?。?/td> 0K
描述： SPARTAN-3 FPGA 50K STD 144-TQFP
產(chǎn)品培訓(xùn)模塊： Extended Spartan 3A FPGA Family
標(biāo)準(zhǔn)包裝： 60
系列： Spartan®-3
LAB/CLB數(shù)： 192
邏輯元件/單元數(shù)： 1728
RAM 位總計(jì)： 73728
輸入/輸出數(shù)： 97
門數(shù)： 50000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-TQFP（20x20）
其它名稱： 122-1720
XC3S50-4TQG144I-ND
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Spartan-3 FPGA Family: Pinout Descriptions
DS099 (v3.1) June 27, 2013
Product Specification
108
I/Os with Lxxy_# are part of a differential output pair. ‘L’ indicates differential output capability. The “xx” field is a two-digit
integer, unique to each bank that identifies a differential pin-pair. The ‘y’ field is either ‘P’ for the true signal or ‘N’ for the
inverted signal in the differential pair. The ‘#’ field is the I/O bank number.
Pin Definitions
Table 70 provides a brief description of each pin listed in the Spartan-3 FPGA pinout tables and package footprint diagrams.
Pins are categorized by their pin type, as listed in Table 69. See Detailed, Functional Pin Descriptions for more information.
VREF
Dual-purpose pin that is either a user-I/O pin or, along with all other VREF pins in
the same bank, provides a reference voltage input for certain I/O standards. If used
for a reference voltage within a bank, all VREF pins within the bank must be
connected.
IO/VREF_#
IO_Lxxy_#/VREF_#
GND
Dedicated ground pin. The number of GND pins depends on the package used. All
must be connected.
GND
VCCAUX
Dedicated auxiliary power supply pin. The number of VCCAUX pins depends on the
package used. All must be connected to +2.5V.
VCCAUX
VCCINT
Dedicated internal core logic power supply pin. The number of VCCINT pins
depends on the package used. All must be connected to +1.2V.
VCCINT
VCCO
Dedicated I/O bank, output buffer power supply pin. Along with other VCCO pins in
the same bank, this pin supplies power to the output buffers within the I/O bank and
sets the input threshold voltage for some I/O standards.
VCCO_#
CP132 and TQ144 Packages Only:
VCCO_LEFT, VCCO_TOP,
VCCO_RIGHT, VCCO_BOTTOM
GCLK
Dual-purpose pin that is either a user-I/O pin or an input to a specific global buffer
input. Every package has eight dedicated GCLK pins.
IO_Lxxy_#/GCLK0,
IO_Lxxy_#/GCLK1,
IO_Lxxy_#/GCLK2,
IO_Lxxy_#/GCLK3,
IO_Lxxy_#/GCLK4,
IO_Lxxy_#/GCLK5,
IO_Lxxy_#/GCLK6,
IO_Lxxy_#/GCLK7
N.C.
This package pin is not connected in this specific device/package combination but
may be connected in larger devices in the same package.
N.C.
Notes:
1.
# = I/O bank number, an integer between 0 and 7.
Table 69: Types of Pins on Spartan-3 FPGAs (Cont’d)
Pin Type/
Color Code
Description
Pin Name
相關(guān)PDF資料
PDF描述
VE-21L-EU CONVERTER MOD DC/DC 28V 200W
GBM08DCMS CONN EDGECARD 16POS .156 WW
TAP336M025CRW CAP TANT 33UF 25V 20% RADIAL
VE-212-EU CONVERTER MOD DC/DC 15V 200W
EP4S100G5H40I2N IC STRATIX IV GT 530K 1517HBGA
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
XC3S50-4VQ100C 制造商:Xilinx 功能描述:FPGA SPARTAN-3 50K GATES 1728 CELLS 630MHZ 1.2V 100VTQFP - Trays
XC3S50-4VQ100I 制造商:Xilinx 功能描述:FPGA SPARTAN-3 50K GATES 1728 CELLS 630MHZ 1.2V 100VTQFP - Trays
XC3S50-4VQG100C 功能描述:IC SPARTAN-3 FPGA 50K 100VTQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:Spartan®-3 標(biāo)準(zhǔn)包裝:60 系列:XP LAB/CLB數(shù):- 邏輯元件/單元數(shù):10000 RAM 位總計(jì):221184 輸入/輸出數(shù):244 門數(shù):- 電源電壓:1.71 V ~ 3.465 V 安裝類型:表面貼裝 工作溫度:0°C ~ 85°C 封裝/外殼:388-BBGA 供應(yīng)商設(shè)備封裝:388-FPBGA（23x23） 其它名稱:220-1241
XC3S50-4VQG100I 功能描述:SPARTAN-3A FPGA 50K STD 100-VQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:Spartan®-3 標(biāo)準(zhǔn)包裝:40 系列:Spartan® 6 LX LAB/CLB數(shù):3411 邏輯元件/單元數(shù):43661 RAM 位總計(jì):2138112 輸入/輸出數(shù):358 門數(shù):- 電源電壓:1.14 V ~ 1.26 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:676-BGA 供應(yīng)商設(shè)備封裝:676-FBGA（27x27）
XC3S50-4VQG100I4022 制造商:Xilinx 功能描述:
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