參數(shù)資料
型號： XC3S50-4TQG144I
廠商： Xilinx Inc
文件頁數(shù)： 90/272頁
文件大?。?/td> 0K
描述： SPARTAN-3 FPGA 50K STD 144-TQFP
產(chǎn)品培訓(xùn)模塊： Extended Spartan 3A FPGA Family
標(biāo)準(zhǔn)包裝： 60
系列： Spartan®-3
LAB/CLB數(shù)： 192
邏輯元件/單元數(shù)： 1728
RAM 位總計： 73728
輸入/輸出數(shù)： 97
門數(shù)： 50000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-TQFP（20x20）
其它名稱： 122-1720
XC3S50-4TQG144I-ND
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Spartan-3 FPGA Family: Functional Description
DS099 (v3.1) June 27, 2013
Product Specification
18
Table 11: DCI Terminations
Termination
Schematic(1)
Signal Standards
(IOSTANDARD)
Controlled impedance output driver
LVDCI_15
LVDCI_18
LVDCI_25
LVDCI_33
HSLVDCI_15
HSLVDCI_18
HSLVDCI_25
HSLVDCI_33
Controlled output driver with half impedance
LVDCI_DV2_15
LVDCI_DV2_18
LVDCI_DV2_25
LVDCI_DV2_33
Single resistor
GTL_DCI
GTLP_DCI
HSTL_III_DCI(2)
HSTL_III_DCI_18(2)
Split resistors
HSTL_I_DCI(2)
HSTL_I_DCI_18(2)
HSTL_II_DCI_18
DIFF_HSTL_II_18_DCI
DIFF_SSTL2_II_DCI
LVDS_25_DCI
LVDSEXT_25_DCI
Split resistors with output driver impedance fixed
to 25
Ω
SSTL18_I_DCI(3)
SSTL2_I_DCI(3)
SSTL2_II_DCI
Notes:
1.
The value of R is equivalent to the characteristic impedance of the line connected to the I/O. It is also equal to half the value of RREF for the
DV2 standards and RREF for all other DCI standards.
2.
For DCI using HSTL Classes I and III, terminations only go into effect at inputs (not at outputs).
3.
For DCI using SSTL Class I, the split termination only goes into effect at inputs (not at outputs).
Z0
IOB
ds099_06a_070903
R
Z0
IOB
ds099_06b_070903
R/2
R
Z0
VCCO
IOB
ds099_06c_070903
2R
Z0
VCCO
IOB
ds099_06d_070903
25
Ω
2R
Z0
VCCO
IOB
ds099_06e_070903
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PDF描述
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XC3S50-4VQG100I4022 制造商:Xilinx 功能描述:
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