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參數(shù)資料
| 型號(hào)： | μPD784044(A) |
| 廠商： | NEC Corp. |
| 英文描述： | 8 Bit Single Chip Microcontrollers(8位單片微控制器) |
| 中文描述： | 8位單片機(jī)微控制器（8位單片微控制器） |
| 文件頁(yè)數(shù)： | 432/549頁(yè) |
| 文件大?。?/td> | 2123K |
| 代理商： | ΜPD784044(A) |
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432
CHAPTER 16 INTERRUPT FUNCTIONS
16.13 Cautions
(1) The in-service priority register (ISPR) is read-only. Writing to this register may result in misoperation.
(2) The watchdog timer mode register (WDM) can only be written to with a dedicated instruction (MOV WDM/#byte).
(3) The RETI instruction must not be used to return from a software interrupt caused by a BRK instruction.
(4) The RETCS instruction must not be used to return from a software interrupt caused by a BRKCS instruction.
(5) Macro service requests are acknowledged and serviced even during execution of a non-maskable interrupt service
program. If you do not want macro service processing to be performed during a non-maskable interrupt service
program, you should manipulate the interrupt mask register in the non-maskable interrupt service program to prevent
macro service generation.
(6) The RETI instruction must be used to return from a non-maskable interrupt. Subsequent interrupt acknowledgment
will not be performed normally if a different instruction is used.
(7) Non-maskable interrupts are always acknowledged, except during non-maskable interrupt service program execu-
tion (except when a high non-maskable interrupt request is generated during execution of a low-priority non-
maskable interrupt service program) and for a certain period after execution of the special instructions shown in 16.9.
Therefore, a non-maskable interrupt will be acknowledged even when the stack pointer (SP) value is undefined, in
particular after reset release, etc. In this case, depending on the value of the SP, it may happen that the program
counter (PC) and program status word (PSW) are written to the address of a write-inhibited special function register
(SFR) (refer to
Table 3-6
in
3.9 Special Function Registers (SFR)
), and the CPU becomes deadlocked, or the PC
and PSW are written to an unexpected signal is output from a pin, or an address is which RAM is not mounted, with
the result that the return from the non-maskable interrupt service program is not performed normally and a software
upsets occurs.
Therefore, the program following RESET release must be as follows.
CSEG AT 0
DW
CSEG BASE
STRT
STRT:
LOCATION 0FH; or LOCATION 0
MOVG SP, #imm24
(8) When a maskable interrupt is acknowledged by vectored interruption, the RETI instruction must be used to return
from the interrupt. Subsequent interrupt related operations will not be performed normally if a different instruction
is used.
(9) The RETCS instruction must be used to return from a context switching interrupt. Subsequent interrupt related
operations will not be performed normally if a different instruction is used.
(10) If data is transmitted with UART by using the macro service, a vectored interrupt is generated two times (refer to
14.2.8 Transmitting/receiving data with macro service
).
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