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參數(shù)資料
| 型號： | μPD98405 |
| 廠商： | NEC Corp. |
| 英文描述： | 155M ATM Integrated SAR Controller(155M ATM SAR集成控制器) |
| 中文描述： | 155M章綜合特區(qū)控制器自動(dòng)柜員機(jī)（155M章自動(dòng)柜員機(jī)特區(qū)集成控制器） |
| 文件頁數(shù)： | 286/391頁 |
| 文件大?。?/td> | 3644K |
| 代理商： | ΜPD98405 |
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CHAPTER 6 PHY FUNCTION
286
Figure 6-11. Relationship between Interrupt Cause Registers
PHY Interrupt Cause Register (PICR)
Interrupt cause details register
Mask register
When any one bit of this register is set to one,
the PI bit of the GSR register is made active.
The timing at which the bits of this register are
cleared varies with the selected interrupt mode.
The interrupt mode is selected according to the
setting of the RCM[1:0] bit of mode register 2
(MDR2).
When the ALM, PFM, and PCO bits are set, the
host reads the corresponding interrupt cause
detail registers to determine the cause of the
interrupt.
PICR register
The user can set the mask
register so as to mask the
issue of interrupts for each
interrupt cause.
OOL
0
LOS LOF ALM PFM PCO RFO
PIMR register
PCO = 1:
Counter overflow
PCOCR1 register
PCOMR1 register
PCOCR2 register
PCOMR2 register
If any one bit of both registers is set to 1,
the PCO bit of the PICR register is set.
PFM = 1
:
Circuit quality degradation fault
PCR register
PCMR register
If any one bit of this register is set to 1, the
PFM bit of the PICR register is also set.
ALM = 1:
Detection of alarm or failure
ACR register
ACMR register
If any one bit of this register is set to 1, the
ALM bit of the PICR register is also set.
By setting the ICR bit of PHY command register 2 (PCMR2) to 1, the bits of all the
interrupt cause-related registers (PICR, ACR, PCR, PCOCR1, and PCOCR2) are
forcibly cleared to 0.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| μPD98408 | ATM Physical Interface(ATM 物理接口) |
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參數(shù)描述 |
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| PD9909-59 | 制造商:Philco/Philips 功能描述: |
| PD9930-51 | 制造商:Philco/Philips 功能描述: |
| PD9933-59 | 制造商:Philco/Philips 功能描述: |
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