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參數(shù)資料
| 型號： | μPD98405 |
| 廠商： | NEC Corp. |
| 英文描述： | 155M ATM Integrated SAR Controller(155M ATM SAR集成控制器) |
| 中文描述： | 155M章綜合特區(qū)控制器自動柜員機（155M章自動柜員機特區(qū)集成控制器） |
| 文件頁數(shù)： | 371/391頁 |
| 文件大?。?/td> | 3644K |
| 代理商： | ΜPD98405 |
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CHAPTER 8 JTAG BOUNDARY SCAN
371
(6) Shift-DR
While the TAP controller is in this state, JDI and JDO are connected according to the current instruction (in
either the boundary scan register or the bypass register). The shift data is shifted, one level at a time, to
the serial output at each rising edge of the signal input to the JCK pin.
When the boundary scan register or bypass register selected with the current instruction is not positioned
in the serial path (when not in the Shift-DR state), the previous state is held. While the TAP controller is in
this state, instruction conversion is not performed.
While the TAP controller is in this state, at a rising edge of the signal input to the JCK pin, the state of the
TAP controller changes as follows:
When the level of the signal being input to the JMS pin is held high: The TAP controller enters the
Exit1-DR state.
When the level of the signal being input to the JMS pin is held low: The TAP controller enters the
Shift-DR state.
(7) Exit1-DR
Exit1-DR is a state that the controller enters temporarily. In this state, at the rising edge of the signal being
input to the JCK pin, if the level of the signal being input to the JMS pin is held high, the TAP controller
enters the Update-DR state. In this way, scan processing is terminated.
On the contrary, at the rising edge of the signal being input to the JCK pin, if the level of the signal being
input to the JMS pin is held low, the TAP controller enters the Pause-DR state.
Regardless of whether the bypass register or boundary scan register is selected with the current
instruction, the previous state is maintained. While the TAP controller is in this state, instruction
conversion is not performed.
(8) Pause-DR
While the TAP controller is in the Pause-DR state, data shift between JDO and JDI, connected to either
the bypass register or boundary scan register, is temporarily halted. These registers, selected with the
current instruction, maintain their previous states.
While the level of the signal being input to the JMS pin is held low, the TAP controller remains in this state.
At the rising edge of the signal being input to the JCK pin, if the level of the signal being input to the JMS
pin is held high, the TAP controller enters the Exit2-DR state. While the TAP controller is in this state,
instruction conversion is not performed.
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PDF描述 |
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