參數(shù)資料
型號(hào)： 37C957FR
廠商： SMSC Corporation
英文描述： ULTRA I/O CONTROLLER FOR PORTABLE APPLICATIONS
中文描述： 超的I / O控制器的便攜式應(yīng)用
文件頁數(shù)： 51/328頁
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代理商： 37C957FR
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Powering up or Reseting the 8051
Default Reset Conditions
The FDC37C957FR has two sources of reset: a VCC1 Power On Reset (VCC1 POR) or a VCC2
POR. An FDC37C957FR reset from any of these sources will cause the hardware response shown in
Table 54 - 8051 On-Chip External Memory Mapped Registers. Note that the values shown are those
prior to any resident firmware control. Refer to Table 54 for the effect of each type of reset on each of
the on-chip registers.
Power-Up Sequence
When the 8051 first powers up by VCC1, the ring oscillator is started, once this has stabilized, the
8051 starts executing from program address 00.
Once running, the 8051 can access all of the
registers that are on VCC1 and if VCC2 is at 5V it can access all of the registers on VCC2. See
Table 54 for VCC1 powered on-chip registers that are reset upon VCC2 Power On Reset (VCC2
POR). It is important that 8051 firmware not initialize or write to any of these registers until 1ms
following VCC2 = 5V AND PWRGD = 1.
Note : In order to guarantee that the external Flash device has powered up and is ready to operate
before the 8051 attempts to access it, the internal VCC1 POR pulse has been extended to 20ms.
The internal VCC1 POR signal is asserted upon VCC1 reaching a valid level and will remain asserted
for a period of 20ms following the assertion of the VCC1_PWRGD pin.
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