參數(shù)資料
型號(hào)： 37C957FR
廠商： SMSC Corporation
英文描述： ULTRA I/O CONTROLLER FOR PORTABLE APPLICATIONS
中文描述： 超的I / O控制器的便攜式應(yīng)用
文件頁(yè)數(shù)： 84/328頁(yè)
文件大?。?/td> 1208K
代理商： 37C957FR
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168
8051 STP_CLK Register
Host
IDX 0x94
8051
N/A
Power
VCC1
Default
0x00
D7
D6
D5-D1
D0
IDLE
HOST_
FLASH
Reserved, set to 0
0=8051 Clock can run
1=8051 clock stop
Note :
When bit D0=1 the 8051’s clock is not stopped unless the RESET_OUT pin is also de-
asserted at which point the Host has access to the Flash Memory.
Note :
Only bit D0 is R/W, bits[7:1] are Read only.
IDLE :
0 = 8051 not in idle mode
1= 8051 in idle mode
HOST_FLASH :
0 = Host does not have access to Flash, in use by 8051
1 = Host has access to Flash
8051 System Power Management
The 80C51 core provides support for two further power-saving modes, available when inactive:
“IDEL” mode, typically entered between keystrokes; and “SLEEP” mode, entered upon command
from the host. The 8051 is wake-able from “SLEEP” mode through a set of external and internal
events called Wake-Up events. The events are listed in Table 57 - System Wake-up Events. When
exiting the “SLEEP” mode, the 8051 will continue executing code from where it left off when put into
“SLEEP” with no changes to the SFR and pins.
The FDC37C957FR is fully static and will pick-up from where it left off in the event of a wake-up
event.
Idle Mode
Entering IDLE mode:
Idle mode is initiated by an instruction that sets the PCON.0 bit (SFR address 87H) in the keyboard.
In idle mode, the internal clock signal to the keyboard CPU is gated off, but not to the Interrupt Timer
and Serial Port functions. The CPU status is preserved in its entirety: the Stack Pointer, Program
Counter, Program Status Word, Accumulator, and all other registers maintain their data.
The port
pins hold the logical levels they had when Idle mode was activated.
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PDF描述
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