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參數(shù)資料
| 型號： | 82C205 |
| 英文描述： | Consumer IC |
| 中文描述： | 消費性IC |
| 文件頁數(shù)： | 13/47頁 |
| 文件大?。?/td> | 460K |
| 代理商： | 82C205 |
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Advance Information
82C205
912-1000-024
Revision 1.0
Page 9
3.3.3.
NTSC/PAL Decoder Interface
Signal Name
Pin
No.
Signal
Type
Signal Description
R[7:0]
2-9
I
Digital Red Input
G[7:0]
10-
17
I
Digital Green Input
– OR –
Digital Luminance Data input for 16-bit NTSC/PAL Decoder Interface or Digital
Luminance and Chrominance Data input for 8-bit NTSC/PAL Decoder Interface.
B[7:0]
18-
25
I
Digital Blue Input
– OR –
Digital Chrominance Data input for 16-bit NTSC/PAL Decoder Interface.
VCLK1
27
I
Video Capture Clock from external line-locked PLL
TV_CK2
30
I
Clock from the NTSC/PAL Decoder.
HSYNC
TV_HS
28
I
Horizontal Sync signal from VGA
– OR –
HREF signal from NTSC/PAL Decoder
VSYNC
TV_VS
29
I
Vertical Sync signal from VGA
– OR –
Odd/Even flag from NTSC/PAL Decoder.
3.3.4.
DRAM Interface
Signal Name
Pin
No.
Signal
Type
Signal Description
DQM#[7:0]
93,
107,
117,
126,
153,
163,
173,
183
O
Data Mask (DQM) for SDRAM.
BS
132
O
SDRAM Bank Select (Active low)
MCLK
144
I/O
Memory clock for Memory Controller and SDRAM.
Internal MCK PLL or External oscillator provides this clock.
MD[63:0]
See
Sec
3.1
I/O
Memory data bus (64-bit).
MA[9:0]
134
-
143
O
Memory address bus signals.
SDRAS#
128
O
SDRAM RAS (Active Low)
SDCAS#
129
O
SDRAM CAS (Active Low)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 82C264 | Peripheral IC |
| 82C281-16 | DRAM/Cache Controller |
| 82C391-25 | System Controller |
| 82C391-33 | System Controller |
| 82C391-40 | System Controller |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 82C206 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:NEW ENHANCED AT DATA BOOK |
| 82C21 | 制造商:UTC-IC 制造商全稱:UTC-IC 功能描述:VOLTAGE DETECTORS |
| 82C211 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:NEW ENHANCED AT DATA BOOK |
| 82C212 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:NEW ENHANCED AT DATA BOOK |
| 82C215 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:NEW ENHANCED AT DATA BOOK |
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