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參數(shù)資料
| 型號： | 935167440557 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, OTPROM, 16 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | 14 X 20 MM, 2.70 MM HEIGHT, PLASTIC, SOT-318-1, QFP-80 |
| 文件頁數(shù)： | 51/112頁 |
| 文件大?。?/td> | 707K |
| 代理商： | 935167440557 |
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1996 Jun 27
43
Philips Semiconductors
Product specication
8-bit microcontroller with on-chip CAN
P8xCE598
13.5.9
BUS TIMING REGISTER 0 (BTR0)
The contents of Bus Timing Register 0 defines the values
of the Baud Rate Prescaler (BRP) and the Synchronization
Jump Width (SJW).
This register can be accessed (read/write) if the Reset
Request bit is set HIGH (present).
For further information on bus timing, see
Sections 13.5.10 and 13.5.18.
Table 45 Bus Timing Register 0 (address 6)
Table 46 Description of the BTR0 bits
76543210
SJW.1
SJW.0
BRP.5
BRP.4
BRP.3
BRP.2
BRP.1
BRP.0
BIT
SYMBOL
FUNCTION
7
SJW.1
Synchronization Jump Width. To compensate for phase shifts between clock
oscillators of different bus controllers, any bus controller must resynchronize on any
relevant signal edge of the current transmission. The synchronization jump width
denes the maximum number of clock cycles a bit period may be shortened or
lengthened by one resynchronization:
6
SJW.0
5
BRP.5
Baud Rate Prescaler. The period of the system clock tSCL is programmable and
determines the individual bit timing.The system clock is calculated using the following
equation:
Where tCLK = time period of the P8xCE598 oscillator.
4
BRP.4
3
BRP.3
2
BRP.2
1
BRP.1
0
BRP.0
t
SJW
t
SCL 2 SJW.1
SJW.0
1
++
()
=
t
SCL
2t
CLK 32BRP.5
16BRP.4
8BRP.3
4BRP.2
2BRP.1
BRP.0
1
+
++++
+
()
=
相關(guān)PDF資料 |
PDF描述 |
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