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參數(shù)資料
| 型號： | 935262451518 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 顏色信號轉(zhuǎn)換 |
| 英文描述： | COLOR SIGNAL DECODER, PQFP100 |
| 封裝： | 14 X 14 X 1.40 MM, PLASTIC, SOT-407, LQFP-100 |
| 文件頁數(shù)： | 19/144頁 |
| 文件大?。?/td> | 592K |
| 代理商： | 935262451518 |
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2000 Mar 15
115
Philips Semiconductors
Preliminary specication
PAL/NTSC/SECAM video decoder with adaptive PAL/NTSC
comb lter, VBI-data slicer and high performance scaler
SAA7114H
Table 91 I-port I/O enable, output clock and gated clock phase control; global set 87H[7:4]
Notes
1. X = don’t care.
2. IPCK3 and IPCK2 only affects the gated clock (subaddress 80H, bit ICKS2 = 1).
Table 92 I-port I/O enable, output clock and gated clock phase control; global set 87H[1:0]
15.5.3
SUBADDRESS 88H
Table 93 Power save control; global set 88H[3] and 88H[1:0]
X = don’t care.
OUTPUT CLOCK AND GATED CLOCK PHASE CONTROL
CONTROL BITS D7 TO D4(1)
IPCK3(2) IPCK2(2) IPCK1 IPCK0
ICLK default output phase
X
0
ICLK phase shifted by 1
2 clock cycle recommended for ICKS1 = 1 and
ICKS0 = 0 (subaddress 80H)
XX
0
1
ICLK phase shifted by about 3 ns
X
1
0
ICLK phase shifted by 1
2 clock cycle + about 3 ns alternatively to setting ‘01’
X
1
IDQ = gated clock default output phase
0
X
IDQ = gated clock phase shifted by 1
2 clock cycle recommended for gated
clock output
01
X
IDQ = gated clock phase shifted by about 3 ns
1
0
X
IDQ = gated clock phase shifted by 1
2 clock cycle + about 3 ns alternatively
to setting ‘01’
11
X
I-PORT I/O ENABLE
CONTROL BITS D1 AND D0
IPE1
IPE0
I-port output is disabled by software
0
I-port output is enabled by software
0
1
I-port output is enabled by pin ITRI at logic 0
1
0
I-port output is enabled by pin ITRI at logic 1
1
POWER SAVE CONTROL
CONTROL BITS
88H[3]
88H[1:0]
SLM3
SLM1
SLM0
Decoder and VBI slicer are in operational mode
X
0
Decoder and VBI slicer are in power-down mode; scaler only operates, if scaler
input and ICLK source is the X-port (refer to subaddresses 80H and 91H/C1H)
XX
1
Scaler is in operational mode
X
0
X
Scaler is in power-down mode; scaler in power-down stops I-port output
X
1
X
Audio clock generation active
0
X
Audio clock generation in power-down and output disabled
1
X
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 935262451557 | COLOR SIGNAL DECODER, PQFP100 |
| 935262469557 | SPECIALTY CONSUMER CIRCUIT, PQFP240 |
| 935263151557 | SPECIALTY CONSUMER CIRCUIT, PQFP240 |
| 935263331557 | SPECIALTY CONSUMER CIRCUIT, PQFP240 |
| 935263133112 | 26 W, 1 CHANNEL, AUDIO AMPLIFIER, PZIP17 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 935264217557 | 制造商:NXP Semiconductors 功能描述:SUB ONLY IC |
| 935267356112 | 制造商:NXP Semiconductors 功能描述:IC TEA1507PN |
| 935268081112 | 制造商:NXP Semiconductors 功能描述:SUB ONLY IC |
| 935268721125 | 制造商:NXP Semiconductors 功能描述:Buffer/Line Driver 1-CH Non-Inverting 3-ST CMOS 5-Pin TSSOP T/R |
| 935269304128 | 制造商:ST-Ericsson 功能描述:IC AUDIO CODEC W/TCH SCRN 48LQFP |
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