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參數(shù)資料
| 型號(hào)： | A42MX16-3VQ100A |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | 40MX and 42MX FPGA Families |
| 中文描述： | 40MX和42MX FPGA系列 |
| 文件頁(yè)數(shù)： | 6/120頁(yè) |
| 文件大?。?/td> | 854K |
| 代理商： | A42MX16-3VQ100A |
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103
4958B–AUTO–11/10
Atmel ATA6285/ATA6286 [Preliminary]
3.13.7.1
The Counter3 Stage
The counter stage has five input signals (CL3, T3ICP, LFDO, CLK
T1 and CLKT2) and five output
sign als (T 3CAP, T 3 OVF , T3 COM A , T3 COM B and CLK
T3 ). The CL3 supplies the
Timer3/Counter3 (T3CNT) with clocks. The external input capture signal (T3ICP), LF-Receiver
data output (LFDO), CLK
T2 signal or CLKT1 signal capture the counter value in the capture regis-
ter. The CLK
T3 is the output clock and T3CAP, T3OVF, T3COMA and T3COMB are the interrupt
request signals of the counter stage.
Figure 3-49. 16-bit Counter3 Stage
3.13.7.2
Signal Description of Timer/Counter3 (Internal Signals)
CLK
T1
Timer/counter1 stage clock output
CLK
T2
Timer/counter2 stage clock output
LFDO
LF-receiver data output
T3ICP
Timer/counter external input capture
CL3
Timer/counter input clock
T3CAP
Timer/counter capture event interrupt
T3OVF
Timer/counter counter overflow interrupt
T3COMA
Timer/counter compare match A interrupt
T3COMB
Timer/counter compare match B interrupt
CLK
T3
Timer/counter stage clock output
CMA
Timer/counter compare register A match
CMB
Timer/counter compare register B match
CA
Compare match A signal
CB
Compare match B signal
RES
Timer/counter reset (clear all bits)
T3OIM
T3CNT
CL3
CLKT1
T3COMB
T3OVF
T3CAP
T3COMA
CLKT3
CLKT2
T3CORA
T3CORB
T3ICR
Timer/Counter
Control
T3RAM
T3RBM
T3CTBM
T3CBIM
T3CPIM
T3CPRM
CB
CA
CPR
T3CPE
CP
OVF
CMA
CMB
RES
T3CTAM
T3CAIM
T3SAMA
T3SAMB
Control
LFDO
T3ICP
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PDF描述 |
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