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參數(shù)資料
| 型號(hào)： | AD9517-2A/PCBZ |
| 廠商： | Analog Devices Inc |
| 文件頁(yè)數(shù)： | 50/80頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | BOARD EVALUATION FOR AD9517-2A |
| 設(shè)計(jì)資源： | AD9517 Eval Brd Schematics AD9517 Gerber Files AD9517-2 BOM |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 主要目的： | 計(jì)時(shí)，時(shí)鐘發(fā)生器 |
| 嵌入式： | 否 |
| 已用 IC / 零件： | AD9517-2A |
| 主要屬性： | 2 輸入，12 輸出，2.2GHz VCO |
| 次要屬性： | CMOS，LVPECL 和 LVDS 兼容 |
| 已供物品： | 板 |
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AD9517-2
Data Sheet
Rev. E | Page 54 of 80
CS
SCLK
SDIO
tHIGH
tLOW
tCLK
tS
tDS
tDH
tC
BIT N
BIT N + 1
06
42
6-
0
43
Figure 69. Serial Control Port Timing—Write
Table 50. Serial Control Port Timing
Parameter
Description
tDS
Setup time between data and rising edge of SCLK
tDH
Hold time between data and rising edge of SCLK
tCLK
Period of the clock
tS
Setup time between CS falling edge and SCLK rising edge (start of communication cycle)
tC
Setup time between SCLK rising edge and CS rising edge (end of communication cycle)
tHIGH
Minimum period that SCLK should be in a logic high state
tLOW
Minimum period that SCLK should be in a logic low state
tDV
SCLK to valid SDIO and SDO (see Figure 67)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| VI-J00-EZ-S | CONVERTER MOD DC/DC 5V 25W |
| ILC0402ER15NK | INDUCTOR CER 15NH 0402 |
| SP1210R-473K | INDUCTOR PWR SHIELDED 47.0UH SMD |
| MCP121T-300E/TT | IC SUPERVISOR 2.93V LOW SOT-23B |
| AD9517-4A/PCBZ | BOARD EVALUATION FOR AD9517-4A |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AD9517-2BCPZ | 制造商:Analog Devices 功能描述:Clock Generator 48-Pin LFCSP EP Tray |
| AD9517-2BCPZ-REEL7 | 制造商:Analog Devices 功能描述: |
| AD9517-2BCPZ-TR | 制造商:Analog Devices 功能描述:OUPUT CLOCK GENERATOR WITH 2.2HZ VCO - Tape and Reel |
| AD9517-3 | 制造商:AD 制造商全稱:Analog Devices 功能描述:12-Output Clock Generator with Integrated 2.0 GHz VCO |
| AD9517-3A/PCBZ | 功能描述:BOARD EVALUATION FOR AD9517-3A RoHS:是 類別:編程器，開發(fā)系統(tǒng) >> 評(píng)估演示板和套件 系列:- 標(biāo)準(zhǔn)包裝:1 系列:PSoC® 主要目的:電源管理，熱管理 嵌入式:- 已用 IC / 零件:- 主要屬性:- 次要屬性:- 已供物品:板，CD，電源 |
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