fREF = i" />
參數(shù)資料
型號： AD9547/PCBZ
廠商： Analog Devices Inc
文件頁數(shù)： 15/104頁
文件大?。?/td> 0K
描述： BOARD EVALUATION FOR AD9547
設(shè)計資源： AD9547 Schematic
AD9574 BOM
標(biāo)準(zhǔn)包裝： 1
主要目的： 計時，時鐘發(fā)生器
嵌入式： 否
已用 IC / 零件： AD9547
主要屬性： 2 個差分式或 4 個單端輸入
次要屬性： CMOS，LVPECL 和 LVDS 兼容
已供物品： 板
AD9547
Data Sheet
Rev. E | Page 18 of 104
TYPICAL PERFORMANCE CHARACTERISTICS
fREF = input reference clock frequency, fO = clock frequency, fSYSCLK = SYSCLK input frequency, fS =internal system clock frequency, LBW =
DPLL loop bandwidth, PLL off = SYSCLK PLL bypassed, PLL on = SYSCLK PLL enabled, ICP = SYSCLK PLL charge pump current, LF =
SYSCLK PLL loop filter. AVDD, AVDD3, and DVDD at nominal supply voltage, fS = 1 GHz, ICP = automatic mode, LF = internal, unless
otherwise noted.
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100k
1M
10M
100M
PH
A
SE
N
O
ISE
(d
B
c
/H
z)
FREQUENCY OFFSET (Hz)
INTEGRATED RMS JITTER (PHASE NOISE):
5kHz TO 20MHz: 173fs (–75.4dBc)
20kHz TO 80MHz: 315fs (–70.2dBc) (EXTRAPOLATED)
08300-
068
Figure 3. Additive Phase Noise (Output Driver = LVPECL),
fREF = 19.44 MHz, fO = 155.52 MHz,
LBW = 1 kHz, fSYSCLK = 1 GHz, PLL Off
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PH
A
SE
N
O
ISE
(d
B
c
/H
z)
FREQUENCY OFFSET (Hz)
INTEGRATED RMS JITTER (PHASE NOISE):
5kHz TO 20MHz: 333fs (–69.8dBc)
20kHz TO 80MHz: 430fs (–67.6dBc) (EXTRAPOLATED)
08300-
056
Figure 4. Additive Phase Noise (Output Driver = LVPECL),
fREF = 19.44 MHz, fO = 155.52 MHz,
LBW = 1 kHz, fSYSCLK = 50 MHz (Crystal), PLL On
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PH
A
SE
N
O
ISE
(d
B
c
/H
z)
FREQUENCY OFFSET (Hz)
INTEGRATED RMS JITTER (PHASE NOISE):
5kHz TO 20MHz: 103fs (–74.0dBc)
20kHz TO 80MHz: 160fs (–70.1dBc)
08300-
066
Figure 5. Additive Phase Noise (Output Driver = LVPECL),
fREF = 19.44 MHz, fO = 311.04 MHz,
LBW = 1 kHz, fSYSCLK = 1 GHz, PLL Off
–160
–150
–140
–130
–120
–110
–100
–90
–80
–70
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1k
10k
100k
1M
10M
100M
PH
A
SE
N
O
ISE
(d
B
c
/H
z)
FREQUENCY OFFSET (Hz)
INTEGRATED RMS JITTER (PHASE NOISE):
5kHz TO 20MHz: 310fs (–64.4dBc)
20kHz TO 80MHz: 330fs (–63.9dBc)
08300-
067
Figure 6. Additive Phase Noise (Output Driver = LVPECL),
fREF = 19.44 MHz, fO = 311.04 MHz,
LBW = 1 kHz, fSYSCLK = 50 MHz (Crystal), PLL On
相關(guān)PDF資料
PDF描述
UPA1E331MPD1TD CAP ALUM 330UF 25V 20% RADIAL
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VI-J0T-EZ-S CONVERTER MOD DC/DC 6.5V 25W
AD9540/PCBZ BOARD EVAL CLK GEN SYNTH 48LFCSP
HCM15DSEH-S243 CONN EDGECARD 30POS .156 EYELET
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AD9548BCPZ-REEL7 功能描述:IC CLOCK GEN/SYNCHRONIZR 88LFCSP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 專用 系列:- 標(biāo)準(zhǔn)包裝:28 系列:- 類型:時鐘/頻率發(fā)生器 PLL:是 主要目的:Intel CPU 服務(wù)器 輸入:時鐘 輸出:LVCMOS 電路數(shù):1 比率 - 輸入:輸出:3:22 差分 - 輸入:輸出:無/是 頻率 - 最大:400MHz 電源電壓:3.135 V ~ 3.465 V 工作溫度:0°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:64-TFSOP （0.240"，6.10mm 寬） 供應(yīng)商設(shè)備封裝:64-TSSOP 包裝:管件
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