tSFSE/I DRIVE SAMPLE DRIVE tDTENLFSE
參數(shù)資料
型號(hào)： ADSP-21065LKCAZ240
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 28/44頁(yè)
文件大小： 0K
描述： IC DSP CTLR 32BIT 196CSPBGA
產(chǎn)品培訓(xùn)模塊： SHARC Processor Overview
標(biāo)準(zhǔn)包裝： 1
系列： SHARC®
類型： 浮點(diǎn)
接口： 主機(jī)接口，串行端口
時(shí)鐘速率： 60MHz
非易失內(nèi)存： 外部
芯片上RAM： 64kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 3.30V
工作溫度： 0°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 196-BGA，CSPBGA
供應(yīng)商設(shè)備封裝： 196-CSPBGA（15x15）
包裝： 托盤
REV. C
ADSP-21065L
–34–
tSFSE/I
DRIVE
SAMPLE
DRIVE
tDTENLFSE
tDDTLFSE
EXTERNAL RFS with MCE = 1, MFD = 0
1ST BIT
2ND BIT
DT
RCLK
RFS
LATE EXTERNAL TFS
tHOFSE/I
tHDTE/I
tDDTE/I
tSFSE/I
DRIVE
SAMPLE
DRIVE
tDTENLFSE
tDDTLFSE
1ST BIT
2ND BIT
DT
TCLK
TFS
tHOFSE/I
tHDTE/I
tDDTE/I
Figure 21. External Late Frame Sync (Frame Sync Setup < tSCLK/2)
DRIVE
SAMPLE
DRIVE
tDTENLSCK
EXTERNAL RFS with MCE = 1, MFD = 0
1ST BIT
2ND BIT
DT
RCLK
RFS
LATE EXTERNAL TFS
tHOFSE/I
tHDTE/I
tDDTE/I
tDDTLSCK
tSFSE/I
DRIVE
SAMPLE
DRIVE
tDTENLSCK
1ST BIT
2ND BIT
DT
TCLK
TFS
tHOFSE/I
tHDTE/I
tDDTE/I
tDDTLSCK
tSFSE/I
Figure 22. External Late Frame Sync (Frame Sync Setup > tSCLK/2)
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PDF描述
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