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參數(shù)資料
| 型號(hào)： | AT85C51SND3B1-RTTUL |
| 廠商： | Atmel |
| 文件頁數(shù)： | 52/119頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DECODER/ENCODER DGTL 100-LQFP |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 類型： | 音頻編碼器/解碼器 |
| 應(yīng)用： | 移動(dòng)電話，手機(jī)，視頻顯示器 |
| 電壓 - 電源，數(shù)字： | 1.65 V ~ 3.6 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LQFP |
| 供應(yīng)商設(shè)備封裝： | 100-LQFP（14x14） |
| 包裝： | 托盤 |
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38
AT85C51SND3B
7632D–MP3–01/07
SFR Registers
The Special Function Registers (SFRs) of the AT85C51SND3B fall into the categories
values detailed in Table 38 and XXh is the hexadecimal address from 80h to FFh
Table 38. Page Address Notation
The SFRs mapping within pages is provided together with SFR reset value in Table 58
to Table 58. In these tables, the bit-addressable registers are identified by Note 1.
Note:
Available in AT85C51SND3B2 only.
P
Comment
Y
Register mapped in all pages
3-0
Register mapped in the corresponding page
Table 39. C51 Core SFRs
Mnemonic Add Name
7
6
5
4
3
2
1
0
ACC
Y.E0h Accumulator
B
Y.F0h B Register
PSW
Y.D0h Program Status Word
CY
AC
F0
RS1
RS0
OV
F1
P
SP
Y.81h Stack Pointer
DPL
Y.82h Data Pointer Low Byte
DPH
Y.83h Data Pointer High Byte
PPCON
Y.C0h Peripheral Pagination
-
PPS3:0
Table 40. Power and System Management
Mnemonic Add Name
7
6
5
4
3
2
1
0
PCON
0.87h Power Control
VBCEN
VBPEN
DCPBST
GF0
DCEN*
PMLCK
PD
IDL
PSTA
0.86h Power Status
UVDET
HVDET
-
WDTRST
EXTRST
PFDRST
AUXR1
0.A2h Auxiliary Register 1
-
GF3
0
-
DPS
VBAT
0.85h Battery Voltage Monitoring
VBEN
VBERR
-
VB4:0
SVERS
3.97h Silicon Version
SV7:0
Table 41. Clock Management Unit SFRs
Mnemonic Add Name
7
6
5
4
3
2
1
0
CKCON
0.8Fh Clock Control
-
WDX2
-
OSCF1:0
T1X2
T0X2
X2
CKEN
0.B9h Clock Enable
CKGENE
PLLEN
-
PLOCK
MMCKEN
-
SIOCKEN
DFCKEN
CKSEL
0.BAh Clock Selection
DNFCKS2:0
PLLCKS1:0
SIOCKS
SYSCKS1:0
PLLCLK
0.BCh PLL Clock
PLLR3:0
PLLN3:0
MMCCLK
0.BDh MMC Clock
MMCCKS2:0
MMCDIV4:0
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