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參數(shù)資料
| 型號： | ATMEGA103-6AI |
| 廠商： | Atmel |
| 文件頁數(shù)： | 122/141頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 128K 6MHZ A/D IT 64TQFP |
| 產(chǎn)品培訓(xùn)模塊： | megaAVR Introduction |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | AVR® ATmega |
| 核心處理器： | AVR |
| 芯體尺寸： | 8-位 |
| 速度： | 6MHz |
| 連通性： | SPI，UART/USART |
| 外圍設(shè)備： | POR，PWM，WDT |
| 輸入/輸出數(shù)： | 32 |
| 程序存儲器容量： | 128KB（64K x 16） |
| 程序存儲器類型： | 閃存 |
| EEPROM 大小： | 4K x 8 |
| RAM 容量： | 4K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 4 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 64-TQFP |
| 包裝： | 托盤 |
| 配用： | ATSTK501-ND - ADAPTER KIT FOR 64PIN AVR MCU |
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81
ATmega103(L)
0945I–AVR–02/07
Bit 5 – Res: Reserved Bit
This bit is reserved in the ATmega103(L). Warning: When writing ADCSR, a logical “0”
must be written to this bit.
Bit 4 – ADIF: ADC Interrupt Flag
This bit is set (one) when an ADC conversion is complete and the result is written to the
ADC Data Registers are updated. The ADC Conversion Complete interrupt is executed
if the ADIE bit and the I-bit in SREG are set (one). ADIF is cleared by hardware when
executing the corresponding interrupt handling vector. Alternatively, ADIF is cleared by
writing a logical “1” to the flag. Beware that if doing a Read-Modify-Write on ADCSR, a
pending interrupt can be disabled. This also applies if the SBI and CBI instructions are
used.
Bit 3 – ADIE: ADC Interrupt Enable
When this bit is set (one) and the I-bit in SREG is set (one), the ADC Conversion Com-
plete interrupt is activated.
Bits 2..0 – ADPS2..ADPS0: ADC Prescaler Select Bits
These bits determine the division factor between the XTAL frequency and the input
clock to the ADC.
ADC Data Register – ADCL
and ADCH
When an ADC conversion is complete, the result is found in these two registers. It is
essential that both registers are read and that ADCL is read before ADCH.
Table 27. ADC Prescaler Selections
ADPS2
ADPS1
ADPS0
Division Factor
00
0
Invalid
00
1
2
01
0
4
01
1
8
10
0
16
10
1
32
11
0
64
1
128
Bit
151413121110
9
8
$05 ($25)
––––
––
ADC9
ADC8
ADCH
$04 ($24)
ADC7
ADC6
ADC5
ADC4
ADC3
ADC2
ADC1
ADC0
ADCL
7654
321
0
Read/Write
R
RR
R
RR
R
Initial Value
0000
000
0
0000
000
0
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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