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參數(shù)資料
| 型號(hào)： | D950-CORE |
| 廠商： | 意法半導(dǎo)體 |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | 16-Bit Fixed Point Digital Signal Processor DSP Core |
| 中文描述： | 16位定點(diǎn)數(shù)字信號(hào)處理器DSP核 |
| 文件頁(yè)數(shù)： | 78/89頁(yè) |
| 文件大?。?/td> | 560K |
| 代理商： | D950-CORE |
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D950-Core
7.4.2 I/O interface
The terms input and output are related to the DMA controller, external is related to the AS-
DSP.
Referring to the D950-Core pin description, the interrupt controller I/O interface signals are of
different types:
On the D950-Core Side
HOLD (hold request / output)
HOLDACK (hold acknowledge / input)
CLK (clock / input)
INCYCLE (clock / input)
On the Internal Memory Side
XA0/XA15 (Y address bus) with associated control signals (output):
XRD (read / output)
XWR (write / output)
XBS (bus strobe / output)
YA0/YA15 (Y address bus) and YD0/YD15 (Y data bus) with their associated
control signals (clock / input):
YRD (read / input/output)
YWR (write / input/output)
YBS (bus strobe / output)
IA0/IA15 (I address bus) with associated control signals (output):
IRD (read / output)
IWR (write / output)
IBS (bus strobe / output)
O
n the Interrupt Controller Side
DIT(3:0) (interrupt request / output)
DIT_AND (common interrupt request / output)
On the External Side
DMARQ(3:0) (request / one input per channel)
DMACK(3:0) (acknowledge / one output per channel)
DIP_ENA (DITi output enable / input)
RESET (reset / input)
DTACK (cycle extension / input),
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