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參數(shù)資料
| 型號： | DS2153Q-A7+T&R |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 41/60頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC TXRX E1 1-CHIP 5V 44-PLCC |
| 產(chǎn)品培訓(xùn)模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標(biāo)準(zhǔn)包裝： | 500 |
| 功能： | 單芯片收發(fā)器 |
| 接口： | E1 |
| 電路數(shù)： | 1 |
| 電源電壓： | 4.75 V ~ 5.25 V |
| 電流 - 電源： | 65mA |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 44-LCC（J 形引線） |
| 供應(yīng)商設(shè)備封裝： | 44-PLCC（16.59x16.59） |
| 包裝： | 帶卷 (TR) |
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DS2153Q
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14 TIMING DIAGRAMS
Figure 14-1. Receive Side Timing
Figure 14-2. Receive Side Boundary Timing (with Elastic Stores Disabled)
NOTE 1: RCHBLK IS PROGRAMMED TO BLOCK CHANNEL 2.
NOTE 2: RLINK IS PROGRAMMED TO OUTPUT THE Sa4 BITS.
NOTE 3: RLINK IS PROGRAMMED TO OUTPUT THE Sa4 AND Sa8 BITS.
NOTE 4: RLINK IS PROGRAMMED TO OUTPUT THE Sa5 AND Sa7 BITS.
NOTE 5: SHOWN IS A NON-ALIGN FRAME BOUNDARY.
NOTE 1: RSYNC IN THE FRAME MODE (RCR1.6 = 0).
NOTE 2: RSYNC IN THE MULTIFRAME MODE (RCR1.6 = 1).
NOTE 3: RLCLK IS PROGRAMMED TO OUTPUT JUST THE Sa4 BIT.
NOTE 4: RLINK WILL ALWAYS OUTPUT ALL FIVE Sa BITS AS WELL AS THE REST OF THE RECEIVE DATA STREAM.
NOTE 5: THIS DIAGRAM ASSUMES THE CAS MF BEGINS WITH THE FAS WORD.
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PDF描述 |
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參數(shù)描述 |
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| DS2153QN-A7/T&R+ | 制造商:Maxim Integrated Products 功能描述:FRAMER E1/ISDN-PRI/PCM-30 5V 44PLCC - Tape and Reel |
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