±5%, T
參數(shù)資料
型號(hào): DS21Q59DK
廠商: Maxim Integrated Products
文件頁(yè)數(shù): 66/76頁(yè)
文件大?。?/td> 0K
描述: KIT DESIGN FOR DS21Q59
產(chǎn)品培訓(xùn)模塊: Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝: 1
主要目的: 電信,調(diào)幀器和線路接口裝置(LIU)
已用 IC / 零件: DS21Q59
DS21Q59 Quad E1 Transceiver
69 of 76
26.4 Receive AC Characteristics
Table 26-D. AC Characteristics—Receiver
±5%, TA = 0°C to +70°C for DS21Q59L; VDD = 3.3V ±5%, TA = -40°C to +85°C for DS21Q59LN.)
(Figure 26-9 and Figure 26-10)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
(Note 1)
648
(Note 2)
488
(Note 3)
244
(Note 4)
122
SYSCLK Period
tSP
(Note 5)
61
ns
tSH
20
0.5 tSP
SYSCLK Pulse Width
tSL
20
0.5 tSP
ns
RSYNC Setup to SYSCLK Falling
tSU
20
ns
RSYNC Hold from SYSCLK Falling
tHD
20
ns
RSYNC Pulse Width
tPW
50
ns
Delay RCLK to RSER Valid
tD1
50
ns
Delay RCLK to RSYNC, OUTA, OUTB
tD2
50
ns
Delay SYSCLK to RSER Valid
tD3
22
ns
Delay SYSCLK to RSYNC, OUTA,
OUTB
tD4
22
ns
Note 1: SYSCLK = 1.544MHz.
Note 2: SYSCLK = 2.048MHz.
Note 3: SYSCLK = 4.096MHz.
Note 4: SYSCLK = 8.192MHz.
Note 5: SYSCLK = 16.384MHz.
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PDF描述
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