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參數(shù)資料
| 型號： | DSP56303VL100B1 |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 104/108頁 |
| 文件大小： | 0K |
| 描述： | IC DSP 24BIT 100MHZ 196-BGA |
| 標(biāo)準(zhǔn)包裝： | 630 |
| 系列： | DSP563xx |
| 類型： | 定點 |
| 接口： | 主機接口，SSI，SCI |
| 時鐘速率： | 100MHz |
| 非易失內(nèi)存： | ROM（576 B） |
| 芯片上RAM： | 24kB |
| 電壓 - 輸入/輸出： | 3.30V |
| 電壓 - 核心： | 3.30V |
| 工作溫度： | -40°C ~ 100°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 196-LBGA |
| 供應(yīng)商設(shè)備封裝： | 196-MAPBGA（15x15） |
| 包裝： | 托盤 |
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DSP56303 Technical Data, Rev. 11
Freescale Semiconductor
A-5
dc
$6162BC
dc
$E4A245
YDAT_END
;**************************************************************************
;
EQUATES for DSP56303 I/O registers and ports
;
Last update: June 11 1995
;
;**************************************************************************
page
132,55,0,0,0
opt
mex
ioequ
ident
1,0
;------------------------------------------------------------------------
;
EQUATES for I/O Port Programming
;
;------------------------------------------------------------------------
;
Register Addresses
M_HDR EQU $FFFFC9
; Host port GPIO data Register
M_HDDR EQU $FFFFC8
; Host port GPIO direction Register
M_PCRC EQU $FFFFBF
; Port C Control Register
M_PRRC EQU $FFFFBE
; Port C Direction Register
M_PDRC EQU $FFFFBD
; Port C GPIO Data Register
M_PCRD EQU $FFFFAF
; Port D Control register
M_PRRD EQU $FFFFAE
; Port D Direction Data Register
M_PDRD EQU $FFFFAD
; Port D GPIO Data Register
M_PCRE EQU $FFFF9F
; Port E Control register
M_PRRE EQU $FFFF9E
; Port E Direction Register
M_PDRE EQU $FFFF9D
; Port E Data Register
M_OGDB EQU $FFFFFC
; OnCE GDB Register
;------------------------------------------------------------------------
;
EQUATES for Host Interface
;
;------------------------------------------------------------------------
;
Register Addresses
M_HCR EQU $FFFFC2
; Host Control Register
M_HSR EQU $FFFFC3
; Host Status Register
M_HPCR EQU $FFFFC4
; Host Polarity Control Register
M_HBAR EQU $FFFFC5
; Host Base Address Register
M_HRX EQU $FFFFC6
; Host Receive Register
M_HTX EQU $FFFFC7
; Host Transmit Register
;
HCR bits definition
M_HRIE EQU $0
; Host Receive interrupts Enable
M_HTIE EQU $1
; Host Transmit Interrupt Enable
M_HCIE EQU $2
; Host Command Interrupt Enable
M_HF2 EQU $3
; Host Flag 2
M_HF3 EQU $4
; Host Flag 3
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PDF描述 |
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