參數(shù)資料
型號: DSP56303VL100B1
廠商: Freescale Semiconductor
文件頁數(shù): 8/108頁
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描述: IC DSP 24BIT 100MHZ 196-BGA
標準包裝: 630
系列: DSP563xx
類型: 定點
接口: 主機接口,SSI,SCI
時鐘速率: 100MHz
非易失內(nèi)存: ROM(576 B)
芯片上RAM: 24kB
電壓 - 輸入/輸出: 3.30V
電壓 - 核心: 3.30V
工作溫度: -40°C ~ 100°C
安裝類型: 表面貼裝
封裝/外殼: 196-LBGA
供應(yīng)商設(shè)備封裝: 196-MAPBGA(15x15)
包裝: 托盤
DSP56303 Technical Data, Rev. 11
Freescale Semiconductor
A-15
M_SEN EQU 20
; Stack Extension Enable bit in OMR.
;*************************************************************************
;
EQUATES for DSP56303 interrupts
;
Last update: June 11 1995
;
;*************************************************************************
page
132,55,0,0,0
opt
mex
intequ
ident
1,0
if
@DEF(I_VEC)
;leave user definition as is.
else
I_VEC EQU $0
endif
;------------------------------------------------------------------------
; Non-Maskable interrupts
;------------------------------------------------------------------------
I_RESET EQU I_VEC+$00
; Hardware RESET
I_STACK EQU I_VEC+$02
; Stack Error
I_ILL EQU I_VEC+$04
; Illegal Instruction
I_DBG EQU I_VEC+$06
; Debug Request
I_TRAP EQU I_VEC+$08
; Trap
I_NMI EQU I_VEC+$0A
; Non Maskable Interrupt
;------------------------------------------------------------------------
; Interrupt Request Pins
;------------------------------------------------------------------------
I_IRQA EQU I_VEC+$10
; IRQA
I_IRQB EQU I_VEC+$12
; IRQB
I_IRQC EQU I_VEC+$14
; IRQC
I_IRQD EQU I_VEC+$16
; IRQD
;------------------------------------------------------------------------
; DMA Interrupts
;------------------------------------------------------------------------
I_DMA0 EQU I_VEC+$18
; DMA Channel 0
I_DMA1 EQU I_VEC+$1A
; DMA Channel 1
I_DMA2 EQU I_VEC+$1C
; DMA Channel 2
I_DMA3 EQU I_VEC+$1E
; DMA Channel 3
I_DMA4 EQU I_VEC+$20
; DMA Channel 4
I_DMA5 EQU I_VEC+$22
; DMA Channel 5
;------------------------------------------------------------------------
; Timer Interrupts
;------------------------------------------------------------------------
I_TIM0C EQU I_VEC+$24
; TIMER 0 compare
I_TIM0OF EQU I_VEC+$26
; TIMER 0 overflow
I_TIM1C EQU I_VEC+$28
; TIMER 1 compare
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