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參數資料
| 型號： | FW322 |
| 英文描述： | 1394A PCI PHY/Link Open Host Controller Interface |
| 中文描述： | 1394A端口物理層的PCI /鏈接開放主機控制器接口 |
| 文件頁數： | 145/148頁 |
| 文件大小： | 1723K |
| 代理商： | FW322 |
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Lucent Technologies Inc.
145
Data Sheet, Rev. 1
February 2001
FW322
1394A PCI PHY/Link Open Host Controller Interface
Internal Register Configuration
(continued)
The meaning of the register fields with the port status page are defined by Table 129 below.
Table 129. PHY Core Register Port Status Page Fields
Field
Size Type
Power Reset
Value
—
Description
AStat
2
R
TPA line state for the port:
00
2
= invalid.
01
2
= 1.
10
2
= 0.
11
2
= Z.
TPB line state for the port (same encoding as AStat).
If equal to one, the port is a child; otherwise, a parent. The
meaning of this bit is undefined from the time a bus reset is
detected until the PHY core transitions to state T1: Child
Handshake during the tree identify process (see Section
4.4.2.2 in
IEEE
Standard 1394-1995).
If equal to one, the port is connected.
If equal to one, incoming TPBIAS is detected.
If equal to one, the port is disabled.
Indicates the maximum speed negotiated between this PHY
core port and its immediately connected port; the encoding is
the same as for the PHY core register Max_speed field.
Enable port event interrupts. When set to one, the PHY core
will set Port_event to one if any of connected, bias, disabled,
or fault (for this port) change state.
Set to one if an error is detected during a suspend or resume
operation. A write of one to this bit clears it to zero.
BStat
Child
2
1
R
R
—
0
Connected
Bias
Disabled
Negotiated_speed
1
1
1
3
R
R
0
0
0
RW
R
000
Int_enable
1
RW
0
Fault
1
RW
0
相關PDF資料 |
PDF描述 |
|---|---|
| FW323 | 1394A PCI PHY/Link Open Host Controller Interface |
| FW32305 | 1394A PCI PHY/Link Open Host Controller Interface |
| FW352 | |
| FW501 | TRANSISTOR | MOSFET | N-CHANNEL | 30V V(BR)DSS | 7A I(D) | SO |
| FW801A | Low-Power PHY IEEE 1394A-2000 One-Cable Transceiver/Arbiter Device |
相關代理商/技術參數 |
參數描述 |
|---|---|
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