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參數資料
| 型號： | LM3S101 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Microcontroller |
| 中文描述： | 微控制器 |
| 文件頁數： | 100/284頁 |
| 文件大?。?/td> | 1774K |
| 代理商： | LM3S101 |
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LM3S101 Data Sheet
March 22, 2006
100
Preliminary
Register 1: GPIO Data (GPIODATA), offset 0x000
The
GPIODATA
register is the data register. In software control mode, values written in the
GPIODATA
register are transferred onto the GPIO port pins if the respective pins have been
configured as outputs through the
GPIO Direction (GPIODIR)
register (see page 101).
In order to write to
GPIODATA
, the corresponding bits in the mask, resulting from the address bus
bits [9:2], must be High. Otherwise, the bit values remain unchanged by the write.
Similarly, the values read from this register are determined for each bit by the mask bit derived
from the address used to access the data register, bits [9:2]. Bits that are 1 in the address mask
cause the corresponding bits in
GPIODATA
to be read, and bits that are 0 in the address mask
cause the corresponding bits in
GPIODATA
to be read as 0, regardless of their value.
A read from
GPIODATA
returns the last bit value written if the respective pins are configured as
output, or it returns the value on the corresponding input pin when these are configured as inputs.
All bits are cleared by a reset.
Bit
Name
Type
Reset
Description
31:8
reserved
RO
0
Reserved bits return an indeterminate value, and should never
be changed.
7:0
DATA
R/W
0
GPIO Data
This register is virtually mapped to 256 locations in the address
space. To facilitate the reading and writing of data to these
registers by independent drivers, the data read from and the data
written to the registers are masked by the eight address lines
ipaddr[9:2]
. Reads from this register return its current
state. Writes to this register only affect bits that are not masked
by
ipaddr[9:2]
and are configured as outputs. See “Data
Register Operation” on page 95 for examples of reads and
writes.
reserved
RO
0
GPIO Data (GPIODATA)
Offset 0x000
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
16
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Reset
Type
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
RO
RO
RO
RO
RO
RO
RO
RO
RO
RO
RO
RO
RO
RO
RO
RO
0
Reset
Type
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
RO
RO
RO
RO
RO
RO
RO
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
reserved
DATA
相關PDF資料 |
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參數描述 |
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