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參數(shù)資料
| 型號： | LM3S101 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Microcontroller |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 27/284頁 |
| 文件大?。?/td> | 1774K |
| 代理商： | LM3S101 |
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ARM Cortex-M3 Processor Core
27
March 22, 2006
Preliminary
2.1
Block Diagram
Figure 2-1.
CPU High-Level Block Diagram
2.2
Functional Description
Important:
The
ARM Cortex-M3 Technical Reference Manual
describes all the features of
an ARM Cortex-M3 in detail. However, these features differ based on the
implementation. This section describes the Stellaris implementation.
Luminary Micro has implemented the ARM Cortex-M3 core as shown in Figure 2-1. As noted in
the
ARM Cortex-M3 Technical Reference Manual
, several Cortex-M3 components are flexible
in their implementation: SW/JTAG-DP, ETM, TPIU, the ROM table, the MPU, and the Nested
Vectored Interrupt Controller (NVIC).
2.2.1
Serial Wire and JTAG Debug
Luminary Micro has replaced the ARM SW-DP and JTAG-DP with the ARM CoreSight-
compliant Serial Wire JTAG Debug Port (SWJ-DP) interface. This means Chapter 12, “Debug
Port,” of the
ARM Cortex-M3 Technical Reference Manual
does not apply to the Stellaris
devices.
The SWJ-DP interface combines the SWD and JTAG debug ports into one module. See the
CoreSight Design Kit Technical Reference Manual
for details on SWJ-DP.
Private Peripheral
Bus
(internal)
Data
Watchpoint
and Trace
Interrupts
Debug
Sleep
Instrumentatio
n Trace
Macrocell
Trace
Port
Interface
Unit
CM3 Core
Instructions
Data
Flash
Patch and
Breakpoint
Adv. High-
Perf. Bus
Access Port
Nested
Vectored
Interrupt
Controller
Serial Wire JTAG
Debug Port
Bus
Matrix
Adv. Peripheral
Bus
I-code bus
D-code bus
System bus
ROM
Table
Private
Peripheral
Bus
(external)
Serial
Wire
Trace
Port
(SWO)
ARM
Cortex-M3
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