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參數資料
| 型號： | LM3S101 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Microcontroller |
| 中文描述： | 微控制器 |
| 文件頁數： | 96/284頁 |
| 文件大小： | 1774K |
| 代理商： | LM3S101 |
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LM3S101 Data Sheet
March 22, 2006
96
Preliminary
During a read, if the address bit associated with the data bit is set to 1, the value is read. If the
address bit associated with the data bit is set to 0, it is read as a zero, regardless of its actual
value. For example, reading address GPIODATA + 0x0C4 yields as shown in Figure 8-4.
Figure 8-4.
GPIODATA Read Example
8.2.2
Data Direction
The
GPIO Direction (GPIODIR)
register (see page 101) is used to configure each individual pin
as an input or output.
8.2.3
Interrupt Operation
The interrupt capabilities of each GPIO port are controlled by a set of seven registers. With these
registers, it is possible to select the source of the interrupt, its polarity, and the edge properties.
When one or more GPIO inputs cause an interrupt, a single interrupt output is sent to the interrupt
controller for the entire GPIO port. For edge-triggered interrupts, software must clear the interrupt
to enable any further interrupts. For a level-sensitive interrupt, it is assumed that the external
source holds the level constant for the interrupt to be recognized by the controller.
Three registers are required to define the edge or sense that causes interrupts:
GPIO Interrupt Sense (GPIOIS)
register (see page 102)
GPIO Interrupt Both Edges (GPIOIBE)
register (see page 103)
GPIO Interrupt Event (GPIOIEV)
register (see page 104)
Interrupts are enabled/disabled via the
GPIO Interrupt Mask (GPIOIM)
register (see page 105).
When an interrupt condition occurs, the state of the interrupt signal can be viewed in two locations:
the
GPIO Raw Interrupt Status (GPIORIS)
and
GPIO Masked Interrupt Status (GPIOMIS)
registers (see pages 106 and 107). As the name implies, the
GPIOMIS
register only shows
interrupt conditions that are allowed to be passed to the controller. The
GPIORIS
register indicates
that a GPIO pin meets the conditions for an interrupt, but has not necessarily been sent to the
controller.
Interrupts are cleared by writing a 1 to the
GPIO Interrupt Clear (GPIOICR)
register (see
page 108).
When programming interrupts, the interrupts should be masked (
GPIOIM
set to 0). Writing any
value to an interrupt control register (
GPIOIS
,
GPIOIBE
, or
GPIOIEV
) can generate a spurious
interrupt if the corresponding bits are enabled.
8.2.4
Mode Control
The GPIO pins can be controlled by either hardware or software. When hardware control is
enabled via the
GPIO Alternate Function Select (GPIOAFSEL)
register (see page 109), the pin
state is controlled by its alternate function (that is, the peripheral). Software control corresponds to
GPIO mode, where the
GPIODATA
register is used to read/write the corresponding pins.
Returned Value
0
1
0
1
0
0
0
0
7
5
6
4
2
3
1
0
ADDR[9:2]
9
7
8
6
4
5
3
2
1
0
1
1
GPIODATA
1
1
0
1
1
0
0x0C4
0
1
0
1
0
0
0
1
0
0
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