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參數(shù)資料
| 型號： | LM3S101 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Microcontroller |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 263/284頁 |
| 文件大?。?/td> | 1774K |
| 代理商： | LM3S101 |
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Signal Tables
263
March 22, 2006
Preliminary
15
Signal Tables
The following tables list the signals available for each pin. Functionality is enabled by software with
the
GPIOAFSEL
register (see page 109).
Important:
All multiplexed pins are GPIOs by default, with the exception of the five JTAG pins
(
PB7
and
PC[3:0]
) which default to the JTAG functionality.
Table 15-1 shows the pin-to-signal-name mapping, including functional characteristics of the
signals. Table 15-2 lists the signals in alphabetical order by signal name. Table 15-3 groups the
signals by functionality. Table 15-4 lists the GPIO pins and their alternate functionality.
Table 15-1.
Signals by Pin Number (Sheet 1 of 2)
Pin
Number
Signal Name
Pin
Type
Buffer
Type
Description
1
PB7
I/O
TTL
GPIO port B bit 7.
TRST
I
TTL
JTAG TAP reset input.
2
PB6
I/O
TTL
GPIO port B bit 6.
C0+
I
Analog
Analog comparator 0 positive reference input.
3
PB5
I/O
TTL
GPIO port B bit 5.
C0o
O
TTL
Analog comparator 0 output.
C1–
I
Analog
Analog comparator 1 negative reference input.
4
PB4
I/O
TTL
GPIO port B bit 4.
C0–
I
Analog
Analog comparator 0 negative reference input.
5
RST
I
TTL
System reset input.
6
LDO
-
Power
The linear drop-out regulator output voltage. This pin requires an
external capacitor between the pin and GND of 1
μ
F or greater.
7
VDD
-
Power
Positive supply for logic and I/O pins.
8
GND
-
Power
Ground reference for logic and I/O pins.
9
OSC0
I
Analog
Oscillator crystal input or an external clock reference input.
10
OSC1
O
Analog
Oscillator crystal output.
11
PA0
I/O
TTL
GPIO port A bit 0.
U0Rx
I
TTL
UART0 receive data input.
12
PA1
I/O
TTL
GPIO port A bit 1.
U0Tx
O
TTL
UART0 transmit data output.
13
PA2
I/O
TTL
GPIO port A bit 2.
SSIClk
I/O
TTL
SSI clock reference (input when in slave mode and output in
master mode).
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PDF描述 |
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