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參數(shù)資料
| 型號： | MC68376BGVFT20B1 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, MROM, 20.97 MHz, MICROCONTROLLER, PQFP160 |
| 封裝： | PLASTIC, QFP-160 |
| 文件頁數(shù)： | 213/440頁 |
| 文件大?。?/td> | 5622K |
| 代理商： | MC68376BGVFT20B1 |
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MC68336/376
ELECTRICAL CHARACTERISTICS
MOTOROLA
USER’S MANUAL
Rev. 15 Oct 2000
A-8
Figure A-1 CLKOUT Output Timing Diagram
Figure A-2 External Clock Input Timing Diagram
6. Specification 9A is the worst-case skew between AS and DS or CS. The amount of skew depends on the relative
loading of these signals. When loads are kept within specified limits, skew will not cause AS and DS to fall outside
the limits shown in specification 9.
7. If multiple chip selects are used, CS width negated (specification 15) applies to the time from the negation of a
heavily loaded chip select to the assertion of a lightly loaded chip select. The CS width negated specification
between multiple chip selects does not apply to chip selects being used for synchronous ECLK cycles.
8. Hold times are specified with respect to DS or CS on asynchronous reads and with respect to CLKOUT on fast
cycle reads. The user is free to use either hold time.
9. Maximum value is equal to (tcyc / 2) + 25 ns.
10. If the asynchronous setup time (specification 47A) requirements are satisfied, the DSACK[1:0] low to data setup
time (specification 31) and DSACK[1:0] low to BERR low setup time (specification 48) can be ignored. The data
must only satisfy the data-in to clock low setup time (specification 27) for the following clock cycle. BERR must
satisfy only the late BERR low to clock low setup time (specification 27A) for the following clock cycle.
11. To ensure coherency during every operand transfer, BG will not be asserted in response to BR until after all cycles
of the current operand transfer are complete and RMC is negated.
12. In the absence of DSACK[1:0], BERR is an asynchronous input using the asynchronous setup time (specification
47A).
13. After external RESET negation is detected, a short transition period (approximately 2 tcyc) elapses, then the SIM
drives RESET low for 512 tcyc.
14. External assertion of the RESET input can overlap internally-generated resets. To insure that an external
reset is recognized in all cases, RESET must be asserted for at least 590 CLKOUT cycles.
15. External logic must pull RESET high during this period in order for normal MCU operation to begin.
68300 CLKOUT TIM
4
CLKOUT
5
2
3
1
68300 EXT CLK INPUT T
4B
EXTAL
5B
2B
3B
1B
NOTE: TIMING SHOWN WITH RESPECT TO 20% AND 70% VDD.
PULSE WIDTH SHOWN WITH RESPECT TO 50% VDD.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SPR-505MVWT31N | DUAL COLOR LED, RED/GREEN, 5 mm |
| SPV200Y3 | SINGLE COLOR LED, YELLOW, 5 mm |
| SR75-3S | TRANSISTOR OUTPUT SOLID STATE RELAY, 1000 V ISOLATION-MAX |
| SSA-H0430-Q10657 | T-1 TRIPLE COLOR LED ARRAY, RED/YELLOW/GREEN, 3 mm |
| SSA-H0432SYD | T-1 SINGLE COLOR LED ARRAY, SUPER YELLOW, 3 mm |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC6839 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:8-BIT MPUS, 8-BIT MCUS, 8-BIT PERIPHERALS |
| MC683K4F | 功能描述:專用陶瓷電容器 USE 581-BT154K683 CAP 400V .068MFD RoHS:否 制造商:Panasonic Electronic Components 電容:470 pF 容差:10 % 電壓額定值:250 VAC 工作溫度范圍:- 25 C to + 125 C 端接類型:SMD/SMT 外殼代碼 - in: 外殼代碼 - mm: |
| MC684 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:INTEGRATED CIRCUITS |
| MC6840 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:8-BIT MPUS, 8-BIT MCUS, 8-BIT PERIPHERALS |
| MC6840CP | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Programmable Timer Module(PTM) |
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