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參數(shù)資料
| 型號： | ML674001TC |
| 廠商： | LAPIS SEMICONDUCTOR CO LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, MROM, 33.333 MHz, RISC MICROCONTROLLER, PQFP144 |
| 封裝： | 20 X 20 MM, 0.50 MM PITCH, PLASTIC, LQFP-144 |
| 文件頁數(shù)： | 78/440頁 |
| 文件大小： | 2769K |
| 代理商： | ML674001TC |
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ML674001 Series/ML675001 Series User’s Manual
Chapter 11
External Memory Controller
11-31
11.3.5
Access Timing Parameters for DRAM
The following Table lists DRAM device speeds compatible with various operating frequencies.
Figuring out the necessary DRAMSPEC bit settings in the DRPC register is left as an exercise for
the reader.
SDRAM
EDO-DRAM (Trac [ns])
Operating
Frequency
(MHz)
PC133
PC125
PC100
PC33
PC66
50
60
70
80
100
60.0
O
33.3
O
30.0
O
16.7
O
15.0
O
8.4
O
7.5
O
The DRAMSPEC bits in the DRPC register specify a combination of access timing parameters
(tRCD, tRAS, tRP, etc.) as shown in the table under the register description. There is no way to
specify these parameters individually.
Minimum Operating Frequencies
Minimum Operating Frequencies (HCLK)
ML674001 Series
ML675001 Series
SDRAM:
2.56 MHz
EDO-DRAM:
6.4 MHz
SDRAM Access Timing Parameters and Operating Frequency
Access Parameters (ns)
Access Parameters (clock
cycles) at 16.7 MHz
Access Parameters (clock
cycles) at 33.3 MHz
SDRAM
Type
(PCxx)
tRCD
tRAS
tRP
tDPL
tRCD
tRAS
tRP
tDPL
tRCD
tRAS
tRP
tDPL
133
15
45
15
10
1
2
1
2
1
133
20
45
20
10
1
2
1
2
1
133
20
45
20
15
1
2
1
2
1
125
20
48
20
8
1
2
1
2
1
125
20
48
20
10
1
2
1
2
1
125
20
50
30
8
1
2
1
2
1
125
24
48
24
10
1
2
1
2
1
100
20
50
20
10
1
2
1
2
1
100
20
50
20
15
1
2
1
2
1
100
20
50
20
1
2
1
2
1
100
30
50
30
15
1
2
1
2
1
100
30
60
30
10
1
2
1
2
1
100
30
60
30
15
1
2
1
2
1
83
35
70
45
24
1
2
1
2
3
2
1
66
30
60
30
15
1
2
1
2
1
66
30
70
30
15
1
2
1
3
1
Note:
The DRAM controller assumes tRC = tRAS + tRP, so also check tRC if the SDRAM specifies
tRC > tRAS + tRP.
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