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參數(shù)資料
| 型號： | PCI6420 |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | Integrated 2-Slot PC Card & Dedicated Flash Media Controller |
| 中文描述： | 集成雙槽 PC 卡專用閃存介質控制器 |
| 文件頁數(shù)： | 73/160頁 |
| 文件大?。?/td> | 818K |
| 代理商： | PCI6420 |
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4
–
7
4.9
Latency Timer Register
The latency timer register specifies the latency timer for the PCI6x20 device, in units of PCI clock cycles. When the
PCI6x20 device is a PCI bus initiator and asserts FRAME, the latency timer begins counting from zero. If the latency
timer expires before the PCI6x20 transaction has terminated, then the PCI6x20 device terminates the transaction
when its GNT is deasserted.
Bit
7
6
5
4
3
2
1
0
Name
Latency timer
Type
RW
RW
RW
RW
RW
RW
RW
RW
Default
0
0
0
0
0
0
0
0
Register:
Offset:
Type:
Default:
Latency timer
0Dh
Read/Write
00h
4.10 Header Type Register
The header type register returns 82h when read, indicating that the PCI6x20 functions 0 and 1 configuration spaces
adhere to the CardBus bridge PCI header. The CardBus bridge PCI header ranges from PCI registers 00h
–
7Fh, and
80h
–
FFh is user-definable extension registers.
Bit
7
6
5
4
3
2
1
0
Name
Header type
Type
R
R
R
R
R
R
R
R
Default
1
0
0
0
0
0
1
0
Register:
Offset:
Type:
Default:
Header type
0Eh (Functions 0, 1)
Read-only
82h
4.11 BIST Register
Because the PCI6x20 device does not support a built-in self-test (BIST), this register returns the value of 00h when
read.
Bit
7
6
5
4
3
2
1
0
Name
BIST
Type
R
R
R
R
R
R
R
R
Default
0
0
0
0
0
0
0
0
Register:
Offset:
Type:
Default:
BIST
0Fh (Functions 0, 1)
Read-only
00h
相關PDF資料 |
PDF描述 |
|---|---|
| PCI6421 | DUAL/SINGLE SOCKET CARDBUS AND ULTRAMEDIA CONTROLLER |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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