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參數(shù)資料
| 型號： | PM7366 |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | FRAME ENGINE AND DATA LINK MANAGER |
| 中文描述： | 8 CHANNEL(S), 52M bps, SERIAL COMM CONTROLLER, PBGA256 |
| 封裝： | BGA-256 |
| 文件頁數(shù)： | 11/286頁 |
| 文件大?。?/td> | 2243K |
| 代理商： | PM7366 |
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RELEASED
DATA SHEET
PM7366 FREEDM-8
ISSUE 4
PMC-1970930
FRAME ENGINE AND DATA LINK MANAGER
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA,INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
ix
FIGURE 24 – CHANNELISED E1 RECEIVE LINK TIMING ...................................................... 249
FIGURE 25 – UNCHANNELISED TRANSMIT LINK TIMING.................................................... 249
FIGURE 26 – CHANNELISED T1 TRANSMIT LINK TIMING.................................................... 250
FIGURE 27 – CHANNELISED E1 TRANSMIT LINK TIMING.................................................... 250
FIGURE 28 – PCI READ CYCLE............................................................................................... 252
FIGURE 29 – PCI WRITE CYCLE............................................................................................. 253
FIGURE 30 – PCI TARGET DISCONNECT .............................................................................. 254
FIGURE 31 – PCI TARGET ABORT.......................................................................................... 254
FIGURE 32 – PCI BUS REQUEST CYCLE............................................................................... 255
FIGURE 33 – PCI INITIATOR ABORT TERMINATION ............................................................. 255
FIGURE 34 – PCI EXCLUSIVE LOCK CYCLE.......................................................................... 256
FIGURE 35 – PCI FAST BACK TO BACK................................................................................. 258
FIGURE 36 – RECEIVE BERT PORT TIMING.......................................................................... 258
FIGURE 37 – TRANSMIT BERT PORT TIMING....................................................................... 259
FIGURE 38 – RECEIVE LINK INPUT TIMING .......................................................................... 264
FIGURE 39 – BERT INPUT TIMING.......................................................................................... 264
FIGURE 40 – TRANSMIT LINK OUTPUT TIMING.................................................................... 265
FIGURE 41 – BERT OUTPUT TIMING...................................................................................... 266
FIGURE 42 – PCI INTERFACE TIMING.................................................................................... 267
FIGURE 43 – JTAG PORT INTERFACE TIMING...................................................................... 268
FIGURE 44 – 256 PIN ENHANCED BALL GRID ARRAY (SBGA)............................................. 270
FIGURE 45 – 272 PIN PLASTIC BALL GRID ARRAY (PBGA).................................................. 271
相關PDF資料 |
PDF描述 |
|---|---|
| PM7366-BI | TVS BI-DIR 30V 1500W DO-201 |
| PM7366-PI | FRAME ENGINE AND DATA LINK MANAGER |
| PM7367-PI | DIODE 1N4002 RECTIFYING |
| PM7367 | 32 link, 32 Channel Data Link Manager with PCI Interface |
| PM7375 | ATM SAR and PHY Processor for PCI Bus |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| PM7366-BI | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
| PM7366-PI | 制造商:PMC-Sierra 功能描述: |
| PM7367 | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
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