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參數(shù)資料
| 型號： | PM7366 |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | FRAME ENGINE AND DATA LINK MANAGER |
| 中文描述： | 8 CHANNEL(S), 52M bps, SERIAL COMM CONTROLLER, PBGA256 |
| 封裝： | BGA-256 |
| 文件頁數(shù)： | 233/286頁 |
| 文件大小： | 2243K |
| 代理商： | PM7366 |
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RELEASED
DATA SHEET
PM7366 FREEDM-8
ISSUE 4
PMC-1970930
FRAME ENGINE AND DATA LINK MANAGER
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA,INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
220
be reset, but not set. A bit is reset whenever the register is written, and the data in the
corresponding bit location is a one.
FBTBE:
The FBTBE bit is hardwired to one to indicate the GPIC supports fast back-to-back
transactions with other targets.
DPR:
The Data Parity Reported (DPR) bit is set high if the GPIC is an initiator and asserts or
detects a parity error on the PERRB signal while the PERREN bit is set in the Command
register. The DPR bit is cleared by the PCI Host.
DVSLT[1:0]:
The Device Select Timing (DEVSLT) bits specify the allowable timings for the assertion of
DEVSELB by the GPIC as a target. These are encoded as 00B for fast, 01B for medium, 10B
for slow and 11B is not used. The GPIC allows for medium timing.
TABT:
The Target Abort (TABT) bit is set high by the GPIC when as a target, it terminates a
transaction with a target abort. The TABT bit is cleared by the PCI Host.
RTABT:
The Received Target Abort (RTABT) bit is set high by the GPIC when as an initiator, its
transaction is terminated by a target abort. The RTABT bit is cleared by the PCI Host.
MABT:
The Master Abort (MABT) bit is set high by the GPIC when as an initiator, its transaction is
terminated by a master abort and a special cycle was not in progress. The MABT bit is
cleared by the PCI Host.
SERR:
The System Error (SERR) bit is set high whenever the GPIC asserts the SERRB output. The
SERR bit is cleared by the PCI Host.
PERR:
The Parity Error (PERR) bit is set high whenever the GPIC detects a parity error, even if parity
error handling is disabled by clearing PERREN in the Command register. The PERR bit is
cleared by the PCI Host.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM7366-BI | TVS BI-DIR 30V 1500W DO-201 |
| PM7366-PI | FRAME ENGINE AND DATA LINK MANAGER |
| PM7367-PI | DIODE 1N4002 RECTIFYING |
| PM7367 | 32 link, 32 Channel Data Link Manager with PCI Interface |
| PM7375 | ATM SAR and PHY Processor for PCI Bus |
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參數(shù)描述 |
|---|---|
| PM7366-BI | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
| PM7366-PI | 制造商:PMC-Sierra 功能描述: |
| PM7367 | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
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