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參數(shù)資料
| 型號(hào)： | PM7366 |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | FRAME ENGINE AND DATA LINK MANAGER |
| 中文描述： | 8 CHANNEL(S), 52M bps, SERIAL COMM CONTROLLER, PBGA256 |
| 封裝： | BGA-256 |
| 文件頁(yè)數(shù)： | 112/286頁(yè) |
| 文件大小： | 2243K |
| 代理商： | PM7366 |
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RELEASED
DATA SHEET
PM7366 FREEDM-8
ISSUE 4
PMC-1970930
FRAME ENGINE AND DATA LINK MANAGER
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA,INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
99
is set low, Big Endian format is selected. When LENDIAN is set high, Little Endian format is
selected. Descriptor references and the contents of descriptors are always transferred in
Little Endian Format. Please refer below for each format's byte ordering.
Table 16 – Big Endian Format
00
Bit 31 24
23 16
15 8
7 Bit 0
DWORD Address
04
BYTE 0
BYTE 1
BYTE 2
BYTE 3
BYTE 4
BYTE 5
BYTE 6
BYTE 7
n-4
BYTE n-4
BYTE n-3
BYTE n-2
BYTE n-1
Table 17 – Little Endian Format
00
Bit 31 24
23 16
15 8
7 Bit 0
DWORD Address
04
BYTE 3
BYTE 2
BYTE 1
BYTE 0
BYTE 7
BYTE 6
BYTE 5
BYTE 4
n-4
BYTE n-1
BYTE n-2
BYTE n-3
BYTE n-4
SOE_E:
The stop on error enable (SOE_E) bit determines the action the PCI controller will take when
a system or parity error occurs. When set high the PCI controller will disconnect the PCI
REQB signal from the PCI bus. This prevents the GPIC from the becoming a master device
on the PCI bus in event of one of the following bits in the PCI Configuration Command/Status
register being set: DPR, RTABT, MABT and SERR. When the SOE_E bit is set low the PCI
controller will continue to allow master transactions on the PCI bus. Setting this bit low after
an error has occurred or clearing the appropriate bit the PCI Configuration Command/Status
register will reactivate the PCI REQB signal and allow the GPIC to resume servicing the local
masters. In the event of a system or parity error it is recommended that the core device be
reset unless the cause of the fault can be determined.
PONS_E:
The Report PERR on SERR enable (PONS_E) bit controls the source of system errors.
When set high all parity errors will be signaled to the host via the SERRB output signal.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM7366-BI | TVS BI-DIR 30V 1500W DO-201 |
| PM7366-PI | FRAME ENGINE AND DATA LINK MANAGER |
| PM7367-PI | DIODE 1N4002 RECTIFYING |
| PM7367 | 32 link, 32 Channel Data Link Manager with PCI Interface |
| PM7375 | ATM SAR and PHY Processor for PCI Bus |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM7366-BI | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
| PM7366-PI | 制造商:PMC-Sierra 功能描述: |
| PM7367 | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
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