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參數資料
| 型號： | PM7367 |
| 廠商： | PMC-Sierra, Inc. |
| 英文描述： | 32 link, 32 Channel Data Link Manager with PCI Interface |
| 中文描述： | 32連接，32通道數據鏈路管理器與PCI接口 |
| 文件頁數： | 196/323頁 |
| 文件大?。?/td> | 2429K |
| 代理商： | PM7367 |
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DATA SHEET
PM7367 FREEDM-32P32
ISSUE 2
PMC-1991499
FRAME ENGINE AND DATA LINK MANAGER
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA, INC., AND FOR ITS CUSTOMER’S INTERNAL USE
182
Register 0x30C : TMAC Descriptor Table Base MSW
Bit
Type
Function
Default
Bit 31
to
Bit 16
Unused
XXXXH
Bit 15
R/W
TDTB[31]
0
Bit 14
R/W
TDTB[30]
0
Bit 13
R/W
TDTB[29]
0
Bit 12
R/W
TDTB[28]
0
Bit 11
R/W
TDTB[27]
0
Bit 10
R/W
TDTB[26]
0
Bit 9
R/W
TDTB[25]
0
Bit 8
R/W
TDTB[24]
0
Bit 7
R/W
TDTB[23]
0
Bit 6
R/W
TDTB[22]
0
Bit 5
R/W
TDTB[21]
0
Bit 4
R/W
TDTB[20]
0
Bit 3
R/W
TDTB[19]
0
Bit 2
R/W
TDTB[18]
0
Bit 1
R/W
TDTB[17]
0
Bit 0
R/W
TDTB[16]
0
This register provides the more significant word of the Transmit Descriptor Table
Base address. The contents of the companion TMAC Transmit Descriptor Table
Base LSW register is held in a holding register until a write access to this
register, at which point, the base address of the transmit descriptor table is
updated.
Note
This register is not byte addressable. Writing to this register modifies all the bits
in the register. Byte selection using byte enable signals (CBEB[3:0]) are not
implemented. However, when all four byte enables are negated, no access is
made to this register.
相關PDF資料 |
PDF描述 |
|---|---|
| PM7375 | ATM SAR and PHY Processor for PCI Bus |
| PM7375-SC | LOCAL ATM SAR & PHYSICAL LAYER |
| PM7380 | FRAME ENGINE AND DATA LINK MANAGER 32P672 |
| PM7380-PI | FRAME ENGINE AND DATA LINK MANAGER 32P672 |
| PM7381 | Frame Engine and Data Link Manager |
相關代理商/技術參數 |
參數描述 |
|---|---|
| PM7367-PI | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
| PM-737 | 制造商:Eclipse Tools 功能描述: |
| PM7375 | 制造商:PMC 制造商全稱:PMC 功能描述:LOCAL ATM SAR & PHYSICAL LAYER |
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