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參數(shù)資料
| 型號： | PM7367 |
| 廠商： | PMC-Sierra, Inc. |
| 英文描述： | 32 link, 32 Channel Data Link Manager with PCI Interface |
| 中文描述： | 32連接，32通道數(shù)據鏈路管理器與PCI接口 |
| 文件頁數(shù)： | 44/323頁 |
| 文件大?。?/td> | 2429K |
| 代理商： | PM7367 |
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DATA SHEET
PM7367 FREEDM-32P32
ISSUE 2
PMC-1991499
FRAME ENGINE AND DATA LINK MANAGER
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA, INC., AND FOR ITS CUSTOMER’S INTERNAL USE
30
8
FUNCTIONAL DESCRIPTION
8.1 High-Level Data Link Control Protocol
Figure 1 shows a diagram of the synchronous HDLC protocol supported by the
FREEDM-32P32. The incoming stream is examined for flag bytes (01111110 bit
pattern) which delineate the opening and closing of the HDLC packet. The
packet is bit de-stuffed which discards a "0" bit which directly follows five
contiguous "1" bits. The resulting HDLC packet size must be a multiple of an
octet (8 bits) and within the expected minimum and maximum packet length
limits. The minimum packet length is that of a packet containing two information
bytes (address and control) and FCS bytes. For packets with CRC-CCITT as
FCS, the minimum packet length is four bytes while those with CRC-32 as FCS,
the minimum length is six bytes. An HDLC packet is aborted when seven
contiguous "1" bits (with no inserted "0" bits) are received.
At least one flag byte
must exist between HDLC packets for delineation. Contiguous flag bytes, or all
ones bytes between packets are used as an "inter-frame time fill". Adjacent flag
bytes may share zeros.
Figure 1 – HDLC Frame
Flag
Information
FCS
Flag
HDLC Packet
Flag
The CRC algorithm for the frame checking sequence (FCS) field is either a
CRC-CCITT or CRC-32 function. Figure 2 shows a CRC encoder block diagram
using the generating polynomial g(X) = 1 + g
1
X + g
2
X
2
+…+ g
n-1
X
n-1
+ X
n
. The
CRC-CCITT FCS is two bytes in size and has a generating polynomial g(X) = 1 +
X
5
+ X
12
+ X
16
. The CRC-32 FCS is four bytes in size and has a generating
polynomial g(X) = 1 + X + X
2
+ X
4
+ X
5
+ X
7
+ X
8
+ X
10
+ X
11
+ X
12
+ X
16
+ X
22
+ X
23
+ X
26
+ X
32
. The first FCS bit received is the residue of the highest term.
相關PDF資料 |
PDF描述 |
|---|---|
| PM7375 | ATM SAR and PHY Processor for PCI Bus |
| PM7375-SC | LOCAL ATM SAR & PHYSICAL LAYER |
| PM7380 | FRAME ENGINE AND DATA LINK MANAGER 32P672 |
| PM7380-PI | FRAME ENGINE AND DATA LINK MANAGER 32P672 |
| PM7381 | Frame Engine and Data Link Manager |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| PM7367-PI | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
| PM-737 | 制造商:Eclipse Tools 功能描述: |
| PM7375 | 制造商:PMC 制造商全稱:PMC 功能描述:LOCAL ATM SAR & PHYSICAL LAYER |
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